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參數(shù)資料
| 型號： | 21041 |
| 廠商： | Intel Corp. |
| 英文描述： | Digital Semiconductor 21041 PCI Ethernet LAN Controller(數(shù)字半導體21041 PCI以太網(wǎng)LAN控制器) |
| 中文描述： | 數(shù)字半導體21041 PCI以太網(wǎng)局域網(wǎng)控制器（數(shù)字半導體21041的PCI以太網(wǎng)局域網(wǎng)控制器） |
| 文件頁數(shù)： | 25/64頁 |
| 文件大?。?/td> | 230K |
| 代理商： | 21041 |
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Table 4 (Cont.) Quick Pin Reference
Signal
Type
Pin
Number
Description
tck
I
120
J TAG clock shifts state information and test
data into and out of the 21041 during J TAG
test operations.
J TAG data in is used to serially shift test data
and instructions into the 21041 during J TAG
test operations.
J TAG data out pin is used to serially shift test
data and instructions out of the 21041 during
J TAG test operations.
J TAG test mode select controls the state
operation of J TAG testing in the 21041.
Twisted-pair negative differential receive
data.
Twisted-pair positive differential receive data.
Twisted-pair negative differential transmit
data. The positive and negative differential
transmit data outputs are resistively
combined outside the 21041 with equalization
to compensate for intersymbol interference on
the twisted-pair medium.
Twisted-pair positive differential transmit
data. The positive and negative differential
transmit data outputs are resistively
combined outside the 21041 with equalization
to compensate for intersymbol interference on
the twisted-pair medium.
(continued on next page)
tdi
I
2
tdo
O
4
tms
I
1
tp_rd–
I
105
tp_rd+
tp_td–
tp_td– –
I
O
104
See
Figure 2.
tp_td+
tp_td+ +
O
See
Figure 2.
17
相關PDF資料 |
PDF描述 |
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參數(shù)描述 |
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