參數(shù)資料
型號(hào)： ZL50116GAG
廠商： ZARLINK SEMICONDUCTOR INC
元件分類： 通信及網(wǎng)絡(luò)
英文描述： 32, 64 and 128 Channel CESoP Processors
中文描述： SPECIALTY TELECOM CIRCUIT, PBGA324
封裝： 23 X 23 MM, 2.03 MM HEIGHT, 1 MM PITCH, PLASTIC, MS-034, BGA-324
文件頁數(shù)： 75/95頁
文件大?。?/td> 1157K
代理商： ZL50116GAG
ZL50115/16/17/18/19/20
Data Sheet
75
Zarlink Semiconductor Inc.
12.5 PAC Interface Timing
12.6 Packet Interface Timing
Data for the MII/GMII/TBI packet switching is based on Specification IEEE Std. 802.3 - 2000.
12.6.1 MII Transmit Timing
Parameter
Symbol
Min.
Typ.
Max.
Units
Notes
TDM_CLKiP High / Low
Pulsewidth
t
CPP
10
-
-
ns
TDM_CLKiS High / Low
Pulsewidth
t
CSP
10
-
-
ns
Table 29 - PAC Timing Specification
Parameter
Symbol
100 Mbps
Units
Notes
Min.
Typ.
Max.
TXCLK period
t
CC
t
CHI
t
CLO
t
CR
t
CF
t
DV
-
40
-
ns
TXCLK high time
14
-
26
ns
TXCLK low time
14
-
26
ns
TXCLK rise time
-
-
5
ns
TXCLK fall time
-
-
5
ns
TXCLK rise to TXD[3:0] active
delay (TXCLK rising edge)
1
-
25
ns
Load = 25 pF
TXCLK to TXEN active delay
(TXCLK rising edge)
t
EV
1
-
25
ns
Load = 25 pF
TXCLK to TXER active delay
(TXCLK rising edge)
t
ER
1
-
25
ns
Load = 25 pF
Table 30 - MII Transmit Timing - 100 Mbps
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PDF描述
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參數(shù)描述
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ZL50117 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:32, 64 and 128 Channel CESoP Processors
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ZL50117GAG2 制造商:Microsemi Corporation 功能描述:PB FREE 4 TDM + 1 ETHERNET - Trays 制造商:Microsemi Corporation 功能描述:PB FREE 4TDM PLUS 1 ETHERNET 制造商:MICROSEMI CONSUMER MEDICAL PRODUCT GROUP 功能描述:IC CESOP PROCESSOR 128CH 324PBGA 制造商:Microsemi Corporation 功能描述:IC CESOP PROCESSOR 128CH 324PBGA
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