參數(shù)資料
型號(hào)： Z80L182
廠商： ZiLOG, Inc.
英文描述： CAP .0001UF 50V POLYPROPYLENE
中文描述： ZiLOG的智能外設(shè)控制器（郵編⑩）
文件頁(yè)數(shù)： 91/109頁(yè)
文件大小： 738K
代理商： Z80L182
3-91
Z80182/Z8L182
Z
ILOG
I
NTELLIGENT
P
ERIPHERAL
P R E L I M I N A R Y
Zilog
DS971820600
Z8S180 AC CHARACTERISTICS
Table A. Z8L180 and Z8S180 Timings
Z8L180
20 MHz
Min
Z8S180
33 MHz
Min
No.
Sym
Parameter
Max
Max
Unit
Note
1
2
3
4
5
tcyc
tCHW
tCLW
tcf
tcr
Clock Cycle Time
Clock Pulse Width (High)
Clock Pulse Width (Low)
Clock Fall Time
Clock Rise Time
50
15
15
2000
30
10
10
2000
ns
ns
ns
ns
ns
[1]
[1]
[1]
[1]
[1]
10
10
5
5
6
7
8
9
tAD
tAS
tMED1
tRDD1
Address Valid fromClock Rise
Address Valid to /MREQ /IORQ /MRD Fall
Clock Fall to /MREQFall Delay
Clock Fall to /RD, /MRD (/IOC=1)
Clock Rise to /RD, /MRD Fall (/IOC=0)
Clock Rise to /M1 Fall delay
15
15
ns
ns
ns
ns
ns
ns
5
5
15
25
35
35
10
15
15
15
10
tM1D1
11
12
13
14
15
tAH
tMED2
tRDD2
tM1D2
tDRS
Address Hold time (/MREQ /IORQ /RD, /WR/MRD)
Clock Fall to /MREQRise Delay
Clock Fall to /RD, /MRD Rise Delay
Clock Rise to /M1 Rise Delay
Data Read Setup Time
5
5
ns
ns
ns
ns
ns
25
25
40
15
15
15
15
15
16
17
18
19
20
tDRH
tSTD1
tSTD2
tWS
tWH
Data Read Hold Time
Clock Edge to ST Fall
Clock Edge to ST Rise
/WAIT Setup Time to Clock Fall
/WAIT Hold Time fromClock Fall
0
0
ns
ns
ns
ns
ns
30
30
15
15
15
10
10
5
[2]
21
22
23
24
25
tWDZ
tWRD1
tWDD
tWDS
tWRD2
Clock Rise to Data Float Delay
Clock Rise to /WR,/MWR Fall Delay
Clock Fall to Write Data Delay
Write Data Setup Time to /WR,/MWR Fall
Clock Fall to /WR Rise
35
25
25
20
15
15
ns
ns
ns
ns
ns
10
10
25
15
26
26a
27
28
tWRP
/WR Pulse Width (Memory Write Cycles)
/WR Pulse Width (I/OWrite Cycles)
Write Data Hold Time from/WR Rise
Clock Fall to /IORQFall Delay (/IOC=1)
Clock Rise to /IORQFall Delay (/IOC=0)
Clock Fall /IOQR Rise Delay
75
130
10
45
70
5
ns
ns
ns
ns
ns
ns
tWDH
tIOD1
25
25
25
15
15
15
29
tIOD2
30
31
32
33
34
tIOD3
tINTS
tINTH
tNMIW
tBRS
/M1 Fall to /IORQFall Delay
/INT Setup Time to Clock Fall
/INT Hold Time fromClock Fall
/NMI Pulse Width
/BUSREQSetup Time to Clock Fall
100
20
10
35
10
80
15
10
25
10
ns
ns
ns
ns
ns
35
36
37
38
39
40
tBRH
tBAD1
tBAD2
tBZD
tMEWH
tMEWL
/BUSREQHold Time fromClock Fall
Clock Rise to /BUSACK Fall Delay
Clock Fall to /BUSACK Rise Delay
Clock Rise to Bus Floating Delay Time
/MREQPulse Width (High)
/MREQPulse Width (Low)
10
10
ns
ns
ns
ns
ns
ns
25
25
40
15
15
30
35
35
25
25
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PDF描述
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參數(shù)描述
Z80L18320ASC 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microprocessor
Z80L183AZ033SCRXXXX 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller
Z80PIO 制造商:Zilog Inc 功能描述:
Z80S183 制造商:ZILOG 制造商全稱:ZILOG 功能描述:Family MPU
Z80S18333ASC 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microprocessor
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