參數(shù)資料
型號： XRT94L33IB-L
廠商： Exar Corporation
文件頁數(shù)： 32/465頁
文件大小： 0K
描述： IC MAPPER DS3/E3/STS-1 504TBGA
標準包裝： 24
應用： 網(wǎng)絡切換
接口： 總線
電源電壓： 3.14 V ~ 3.47 V
封裝/外殼： 504-LBGA
供應商設備封裝： 504-TBGA（35x35）
包裝： 托盤
安裝類型： 表面貼裝
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xr
XRT94L33
3-CHANNEL DS3/E3/STS-1 TO STS-3/STM-1 MAPPER IC DATA SHEET
Rev.1.2.0.
127
Table 4 describes the role of these signals when the Microprocessor Interface is operating in the Motorola
Mode.
Table 2 Description of the Microprocessor Interface Signals that exhibit constant roles in both the
“Intel” and “Motorola” Modes.
PIN NAME
TYPE
DESCRIPTION
D[7:0]
I/O
Bi-Directional Data Bus for register read or write operations.
This byte wide carries all data that is being written into or read from the XRT94L33.
A[14:0]
I
Fourteen Bit Address Bus input:
This nine bit Address Bus is provided to allow the user to select an on-chip register or on-chip
RAM location.
CS*
I
Chip Select input.
This “active low” signal selects the Microprocessor Interface of the XRT94L33 and enables
read/write operations with the on-chip registers/on-chip RAM.
INT*
O
Interrupt Request Output
This “open-drain/active-low” output signal will inform the local
P that the XRT94L33 has an
interrupt condition that needs servicing.
Table 3 Pin Description of Microprocessor Interface Signals - While the Microprocessor Interface is
Operating in the Intel Mode.
PIN NAME
EQUIVALENT PIN IN INTEL
ENVIRONMENT
TYPE
DESCRIPTION
ALE_AS
ALE
I
Address-Latch Enable:
This “active-high” signal is used to latch the
contents on the address bus, A[8:0]. The contents of the Address Bus are
latched into the A[8:0] inputs on the falling edge of ALE_AS. Additionally,
this signal can be used to indicate the start of a burst cycle.
RdB_DS
RD*
I
Read Signal: This “active-low” input functions as the read signal from the
local
P. When this signal goes “l(fā)ow”, the XRT94L33 Microprocessor
Interface will place the contents of the addressed register on the Data Bus
pins
(D[7:0]).
The Data Bus will be “tri-stated” once this input signal
returns “high”.
WRB_RW
WR*
I
Write Signal: This “active-low” input functions as the write signal from the
local
P. The contents of the Data Bus (D[7:0]) will be written into the
addressed register (via A[8:0]), on the rising edge of this signal.
Rdy_Dtck
READY*
O
Ready Output: This “active-low” signal is provided by the XRT94L33, and
indicates that the current read or write cycle is to be extended until this
signal is asserted. The local
P will typically insert “WAIT” states until this
signal is asserted. This output will toggle “l(fā)ow” when the device is ready
for the next Read or Write cycle.
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PDF描述
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