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參數(shù)資料
| 型號(hào)： | XRT83L38IB-F |
| 廠商： | Exar Corporation |
| 文件頁(yè)數(shù)： | 82/87頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC LIU T1/E1/J1 OCTAL 225BGA |
| 標(biāo)準(zhǔn)包裝： | 84 |
| 類型： | 線路接口裝置（LIU） |
| 驅(qū)動(dòng)器/接收器數(shù)： | 8/8 |
| 規(guī)程： | T1，E1，J1 |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 225-BGA |
| 供應(yīng)商設(shè)備封裝： | 225-BGA（19x19） |
| 包裝： | 托盤 |
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XRT83L38
80
REV. 1.0.2
OCTAL T1/E1/J1 LH/SH TRANSCEIVER WITH CLOCK RECOVERY AND JITTER ATTENUATOR
MICROPROCESSOR INTERFACE I/O TIMING
INTEL INTERFACE TIMING - ASYNCHRONOUS
The signals used for the Intel microprocessor interface are: Address Latch Enable (ALE), Read Enable (RD),
Write Enable (WR), Chip Select (CS), Address and Data bits. The microprocessor interface uses minimum ex-
ternal glue logic and is compatible with the timings of the 8051 or 80C188 with an 8-16 MHz clock frequency,
and with the timings of x86 or i960 family or microprocessors. The interface timing shown in Figure 30 and
FIGURE 29. RECEIVE CLOCK AND OUTPUT DATA TIMING
FIGURE 30. INTEL ASYNCHRONOUS PROGRAMMED I/O INTERFACE TIMING
RCLK
R
RCLK
F
RCLK
RPOS
or
RNEG
R
DY
R
HO
AD D R[6:0]
DA TA[7:0]
RD_DS
WR _R/W
RDY _DTAC K
V alid Data for R eadbac k
D ata Available to W rite Into the LIU
R EAD OPER ATIO N
W RITE OPER ATIO N
t
0
t
0
t
1
t
3
t
2
t
4
Valid Address
V alid Addres s
t
5
t
5
ALE_AS
CS
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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