參數(shù)資料
型號(hào)： XRT79L71IB
廠商： Exar Corporation
文件頁(yè)數(shù)： 19/609頁(yè)
文件大小： 0K
描述： IC LIU/FRAMER DS3/E3 1CH 208BGA
標(biāo)準(zhǔn)包裝： 126
控制器類型： DS3/E3 調(diào)幀器
接口： LIU
電源電壓： 3.15 V ~ 3.45 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 208-LBGA
供應(yīng)商設(shè)備封裝： 208-STBGA（17x17）
包裝： 托盤
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PRELIMINARY
XRT79L71
100
REV. P2.0.0
1-CHANNEL DS3/E3 CLEAR-CHANNEL FRAMERLIU COMBO - CC/HDLC ARCHITECTURE
However, the Transmit Section of the XRT79L71 can also be configured to externally accept values via a
certain input port and to insert this data into certain select overhead bits, within the outbound DS3 data-stream.
In this case, these "externally inserted" values for these overhead bits will overwrite that which has been
internally generated by the Transmit DS3/E3 Framer block. The XRT79L71 permits the user to implement this
overhead bit insertion by either of the following two methods.
By configuring the Transmit Section of the XRT79L71 to accept DS3 overhead data via the Transmit Payload
Data Input Interface block (as was discussed in Section 4.2.1.8).
By configuring the Transmit Section of the XRT79L71 to accept DS3 overhead data via the Transmit
Overhead Data Input Interface (This approach will be discussed below).
FEAC bit (1)
Far-End Alarm & Control Bit
This bit carries the FEAC Message that is generated by the Transmit
FEAC Processor within the Transmit Section of the XRT79L71.
However, if the Transmit FEAC Controller block is not being used, then
these bits will each be set to "1".
FEBE bits (3)
Far-End Block Error Bits
These bits are set to [1, 1, 1] whenever the corresponding Receive DS3
Framer block detects no CP nor framing F and M bit errors within its
incoming DS3 data-stream. These bits are set to values other than [1,
1, 1] whenever the corresponding Receive DS3 Framer block detects
CP or framing bit errors within its incoming DS3 data-stream.
NOTE: These bit-fields can also be software-controlled.
TABLE 18: HOW THE TRANSMIT DS3 FRAMER BLOCK INTERNALLY GENERATES EACH OF THE OVERHEAD BITS - M23
APPLICATIONS
BIT NAME
BIT DESCRIPTION
HOW OVERHEAD BIT IS INTERNALLY GENERATED BY THE TRANSMIT DS3
FRAMER BLOCK
X-Bits (2)
FERF/Yellow Alarm Indicator
Bits
Either Software Controlled or automatically set to "0" whenever the corre-
sponding Receive DS3 Framer block declares the LOS, LOF/OOF or AIS
defect condition.
F1 Bits (14)
F-Frame Framing Alignment bits
that are of the value "1"
Set to the value of "1".
F0 Bits (14)
F-Frame Framing Alignment bits
that are of the value "0"
Set to the value of "0".
M1 Bit (1)
M-Frame Framing Alignment
bits that are of the value "1".
Set to the value of "1".
M0 Bit (2)
M-Frame Framing Alignment
bits that are of the value "0".
Set to the value of "0".
P-bits (2)
Parity Bits
Transmit DS3 Framer block computes the even parity value over the pay-
load bits within a given DS3 frame. The results of this calculation are
inserted into the two P-bit positions within the very next DS3 frame.
C-bits (21)
DS2 to DS3 Multiplexing Stuff
Indicator bits
Set to the value of "0".
TABLE 17: HOW THE TRANSMIT DS3 FRAMER BLOCK INTERNALLY GENERATES EACH OF THE OVERHEAD BITS - C-
BIT PARITY APPLICATIONS
BIT NAME
BIT DESCRIPTION
HOW OVERHEAD BIT IS INTERNALLY GENERATED BY THE TRANSMIT DS3
FRAMER BLOCK
相關(guān)PDF資料
PDF描述
PIC24F08KL302T-I/SO IC MCU 16BIT 8KB FLASH 28-SOIC
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PIC24F08KL201T-I/MQ IC MCU 16BIT 8KB FLASH 20-QFN
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參數(shù)描述
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