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參數(shù)資料
| 型號(hào)： | XRT72L52 |
| 廠商： | EXAR CORP |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | DATACOM, FRAMER, PQFP160 |
| 封裝： | 28 X 28 MM, PLASTIC, QFP-160 |
| 文件頁(yè)數(shù)： | 375/481頁(yè) |
| 文件大?。?/td> | 2636K |
| 代理商： | XRT72L52 |
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á
XRT72L52
TWO CHANNEL DS3/E3 FRAMER IC WITH HDLC CONTROLLER
PRELIMINARY
REV. P1.1.3
356
In this mode, the Transmit Section of the XRT72L52
will use the TxInClk signal as its timing reference.
B. Serial Mode
The XRT72L52 will receive the E3 payload data, in a
serial manner, via the TxSer input pin. The Transmit
Payload Data Input Interface (within the XRT72L52)
will latch this data into its circuitry, on the rising edge
of the TxInClk input clock signal.
C. Delineation of Outbound DS3 frames (Frame
Master Mode)
The Transmit Section of the XRT72L52 will use the
TxInClk signal as its timing reference, and will initiate
E3 frame generation, asynchronously with respect to
any externally applied signal. The XRT72L52 will
pulse its TxFrame output pin "High" whenever its it
processing the very last bit-field within a given E3
frame.
D. Sampling of payload data, from the Terminal
Equipment
In Mode 3, the XRT72L52 will sample the data, at the
TxSer input pin, on the rising edge of TxInClk.
Interfacing the Transmit Payload Data Input Inter-
face block of the XRT72L52 to the Terminal Equip-
ment for Mode 3 Operation
Figure 161 presents an illustration of the Transmit
Payload Data Input Interface block (within the
XRT72L52) being interfaced to the Terminal Equip-
ment, for Mode 3 operation.
Mode 3 Operation of the Terminal Equipment
In Figure 161, both the Terminal Equipment and the
XRT72L52 are driven by an external 34.368 MHz
clock signal. This clock signal is connected to the
E3_Clock_In input of the Terminal Equipment and the
TxInClk input pin of the XRT72L52.
The Terminal Equipment will serially output the pay-
load data on its E3_Data_Out output pin, upon the
rising edge of the signal at the E3_Clock_In input pin.
Similarly, the XRT72L52 will latch the data, residing
on the TxSer input pin, on the rising edge of TxInClk.
The XRT72L52 will pulse the TxFrame output pin
"High" for one bit-period, coincident while it is pro-
cessing the last bit-field within a given Outbound E3
frame. The Terminal Equipment is expected to moni-
tor the TxFrame signal (from the XRT72L52) and to
place the first bit, within the very next Outbound E3
frame on the TxSer input pin.
N
OTE
:
In this case, the XRT72L52 dictates exactly when
the very next E3 frame will be generated. The Terminal
Equipment is expected to respond appropriately by provid-
ing the XRT72L52 with the first bit of the new E3 frame,
upon demand. Hence, in this mode, the XRT72L52 is
F
IGURE
161. I
LLUSTRATION
OF
THE
T
ERMINAL
E
QUIPMENT
BEING
INTERFACED
TO
THE
T
RANSMIT
P
AYLOAD
D
ATA
I
NPUT
I
NTERFACE
BLOCK
OF
THE
XRT72L52
FOR
M
ODE
3 (S
ERIAL
/L
OCAL
-T
IMED
/F
RAME
-M
ASTER
) O
PERATION
E3_Clock_In
E3_Data_Out
E3_Data_Out
TxStart_of_Frame
TxStart_of_Frame
E3_Overhead_Ind
E3_Overhead_Ind
E3_Clock_In
TxInClk
TxSer
TxSer
TxFrameRef
TxFrameRef
TxOH_Ind
TxOH_Ind
NibInt
NibInt
TxInClk
Clock Source
34.368 MHz
Clock Source
XRT72L5X E3 Framer
Terminal Equipment
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PDF描述 |
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| XRT72L53 | 制造商:EXAR 制造商全稱:EXAR 功能描述:THREE CHANNEL DS3/E3 FRAMER IC WITH HDLC CONTROLLER |
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