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參數(shù)資料
| 型號(hào)： | XRT72L52 |
| 廠商： | EXAR CORP |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | DATACOM, FRAMER, PQFP160 |
| 封裝： | 28 X 28 MM, PLASTIC, QFP-160 |
| 文件頁(yè)數(shù)： | 112/481頁(yè) |
| 文件大?。?/td> | 2636K |
| 代理商： | XRT72L52 |
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XRT72L52
TWO CHANNEL DS3/E3 FRAMER IC WITH HDLC CONTROLLER
á
PRELIMINARY
REV. P1.1.3
93
1.
When the Receive DS3/E3 Framer block first
detects the occurrence of an Rx FERF Condition
(e.g., when the FERF bit, within the last 3 or 5
consecutive E3 frames are set to "1").
2.
When the Receive DS3/E3 Framer block detects
the end of the Rx FERF Condition (e.g., when the
FERF bit, within the last 3 or 5 consecutive E3
frames are set to "0").
N
OTE
:
For more information on the Rx FERF (Yellow
Alarm) condition, please see Section 4.3.2.9.
Bit 2 - BIP-4 (Detection of BIP-4) Error Interrupt
Status
This Reset-upon-Read bit-field will be set to "1" if the
BIP-4 Error interrupt has occurred since the last read
of this register.
The Receive DS3/E3 Framer block will generate the
BIP-4 Error interrupt if it has concluded that it has re-
ceived an errored E3 frame, from the Remote Termi-
nal.
N
OTE
:
Please see Section 4.3.6.1.7 for a more detailed dis-
cussion of this interrupt.
Bit 1 - Framing Error Interrupt Status
This Reset-upon-Read bit-field will be set to "1" if the
Framing Byte Error interrupt has occurred since the
last read of this register.
The Receive DS3/E3 Framer blockwill generate the
Framing Error interrupt if it has detected an error in
the FAS (or Framing Alignment), in an incoming E3
frame.
N
OTE
:
Please see Section 4.3.6.1.8 for a more detailed dis-
cussion of this interrupt.
2.4.4.7
Receive E3 LAPD Control Register (E3,
ITU-T G.751)
Bit 2 - RxLAPD Enable
This Read/Write bit-field allows the user to enable or
disable the LAPD Receiver, for reception of incoming
LAPD Message frames from the Remote LAPD
Transmitter.
Writing a "1" to this bit-field enables the LAPD Re-
ceiver. Writing a "0" to this bit-field disables the LAPD
Receiver.
Bit 1 - RxLAPD (Received LAPD Message) Inter-
rupt Enable
This Read/Write bit-field allows the user to enable or
disable the Received LAPD Message frame interrupt.
Setting this bit-field to "1" enables this interrupt. Set-
ting this bit-field to "0" disables this interrupt.
N
OTE
:
For more information on this interrupt, please see
Section 4.3.6.1.9.
Bit 0 - RxLAPD (Received LAPD Message) Inter-
rupt Status
This Reset-upon-Read bit-field will be set to "1" if the
Receipt of New LAPD Message frame interrupt has
occurred since the last read of this register.
The Receive DS3/E3 Framer block will generate this
Receipt of New LAPD Message frame interrupt when
the LAPD Receiver has received a complete LAPD
Message frame from the Remote LAPD Transmitter.
N
OTE
:
Please see section 4.3.6.1.9 for a more detailed dis-
cussion of this interrupt.
2.4.4.8
Receive E3 LAPD Status Register (E3,
ITU-T G.751)
RXE3 LAPD CONTROL REGISTER (ADDRESS = 0X18)
B
IT
7
B
IT
6
B
IT
5
B
IT
4
B
IT
3
B
IT
2
B
IT
1
B
IT
0
Not Used
RxLAPD
Enable
RxLAPD
Interrupt
Enable
RxLAPD
Interrupt
Enable
RO
RO
RO
RO
RO
R/W
R/W
RUR
0
0
0
0
0
0
0
0
RXE3 LAPD STATUS REGISTER (ADDRESS = 0X19)
B
IT
7
B
IT
6
B
IT
5
B
IT
4
B
IT
3
B
IT
2
B
IT
1
B
IT
0
Not Used
RxAbort
RxLAPDType[1:0]
RxCR Type
RxFCS Error
End of
Message
Flag Present
RO
RO
RO
RO
RO
RO
RO
RO
0
0
0
0
0
0
0
0
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