參數(shù)資料
型號： XC2S100E-6FTG256C
廠商： Xilinx Inc
文件頁數(shù)： 41/108頁
文件大小： 0K
描述： IC SPARTAN-IIE FPGA 100K 256FBGA
產(chǎn)品變化通告： FPGA Family Discontinuation 18/Apr/2011
標(biāo)準(zhǔn)包裝： 90
系列： Spartan®-IIE
LAB/CLB數(shù)： 600
邏輯元件/單元數(shù)： 2700
RAM 位總計(jì)： 40960
輸入/輸出數(shù)： 182
門數(shù)： 100000
電源電壓： 1.71 V ~ 1.89 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 256-LBGA
供應(yīng)商設(shè)備封裝： 256-FTBGA
其它名稱： 122-1322
38
DS077-3 (v3.0) August 9, 2013
Product Specification
Spartan-IIE FPGA Family: DC and Switching Characteristics
R
— OBSOLETE — OBSOLETE — OBSOLETE — OBSOLETE —
IOB Input Delay Adjustments for Different Standards
Input delays associated with the pad are specified for LVTTL. For other standards, adjust the delays by the values shown. A
delay adjusted in this way constitutes a worst-case limit.
Symbol
Description
Standard
Speed Grade
Units
-7
-6
Data Input Delay Adjustments
TILVTTL
Standard-specific data input delay
adjustments
LVTTL
0
ns
TILVCMOS2
LVCMOS2
0
ns
TILVCMOS18
LVCMOS18
0.20
ns
TILVDS
LVDS
0.15
ns
TILVPECL
LVPECL
0.15
ns
TIPCI33_3
PCI, 33 MHz, 3.3V
0.08
ns
TIPCI66_3
PCI, 66 MHz, 3.3V
–0.11
ns
TIGTL
GTL
0.14
ns
TIGTLP
GTL+
0.14
ns
TIHSTL
HSTL
0.04
ns
TISSTL2
SSTL2
0.04
ns
TISSTL3
SSTL3
0.04
ns
TICTT
CTT
0.10
ns
TIAGP
AGP
0.04
ns
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PDF描述
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