參數資料
型號： VSP3000Y
英文描述： 12-Bit, 6MHz CCD/CIS SIGNAL PROCESSOR
中文描述： 12位，6MHz的防治荒漠化公約/ CIS信號處理器
文件頁數： 6/13頁
文件大?。?/td> 145K
代理商： VSP3000Y
6
VSP3000
TIMING DIAGRAMS
3-Channel CCD Mode Timing
3-Channel CIS Mode Timing
t
CCK
t
CCK
t
CKP
t
CNV
t
ADCCK1
t
S
G
R
R1
G1
B1
B
t
CK1A
t
SET
R1, G1, B1
t
CK1AP
t
ST
CIS
STRT
CK1
ADCCK
1-Channel CCD Mode Timing
t
CK1BP
t
CK2B
t
CNV
t
CK21B
t
S
t
S
t
CKP
t
CK12B
t
SET
t
CK1B
t
CCK
t
CCK
Pixel 1
CCD
STRT
CK1
CK2
ADCCK
Pixel 1
t
CKP
t
CCK
t
CCK
t
CK12A
t
CK2A
t
SET
t
CK21A
t
ST
t
CK1AP
t
CK1A
t
S
t
S
t
CNV
t
ADCCK2
G
R
R1
G1
B1
B
R1, G1, B1
CCD
STRT
CK1
CK2
ADCCK
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PDF描述
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