參數(shù)資料
型號： VSP3000Y
英文描述： 12-Bit, 6MHz CCD/CIS SIGNAL PROCESSOR
中文描述： 12位，6MHz的防治荒漠化公約/ CIS信號處理器
文件頁數(shù)： 2/13頁
文件大?。?/td> 145K
代理商： VSP3000Y
2
VSP3000
SPECIFICATIONS
At T
A
= full specified temperature range, V
DDA
= +5V, V
DDD
= +5V, f
ADCCK
= 6MHz, f
CK1
= 2MHz, f
CK2
= 2MHz, and PGA gain = 1, unless otherwise specified.
VSP3000Y
PARAMETER
CONDITIONS
MIN
TYP
MAX
UNITS
RESOLUTION
12
Bits
°
C
SPECIFIED TEMPERATURE RANGE
0 to +85
CONVERSION CHARACTERISTICS
3-Channel CDS Mode
3-Channel CIS Mode
6
6
MHz
MHz
ANALOG INPUTS
Full-Scale Input Range
Input Capacitance
Input Limits
0.5
3.5
Vp-p
pF
V
10
GND
A
– 0.3
V
DDA
+ 0.3
DYNAMIC CHARACTERISTICS
Integral Non-Linearity (INL)
Differential Non-Linearity (DNL)
No Missing Codes
Input-Referred Noise
±
1
0.3
12
0.3
±
2
0.75
LSB
LSB
Bits
LSBs rms
PSRR
0.04
% FSR
DIGITAL INPUTS
Logic Family
Convert Command
High Level Input Current (V
IN
= V
DDD
)
Low Level Input Current (V
IN
= 0V)
High Level Input Voltage
Low Level Input Voltage
Input Capacitance
CMOS
Start Conversion
Rising Edge of ADCCK
10
10
μ
A
μ
A
V
V
pF
3.5
1
5
DIGITAL OUTPUTS
Logic Family
Logic Coding
V
DRV
Supply Range
Output Voltage, V
DRV
= +5V
Low Level
High Level
Low Level
High Level
Output Voltage, V
DRV
= +3
Low Level
High Level
3-State Enable Time
3-State Enable Time
Output Capacitance
Data Latency
Data Output Delay
CMOS
Straight Binary
+2.7
+5.3
V
I
OL
= 50
μ
A
I
OH
= 50
μ
A
I
OL
= 1.6mA
I
OH
= 0.5mA
+0.1
V
V
V
V
+4.6
+0.4
+2.4
I
OL
= 50
μ
A
I
OH
= 50
μ
A
OE = LOW
OE = HIGH
+0.1
V
V
ns
ns
pF
+2.5
20
2
5
6
40
10
Clock Cycles
ns
C
L
= 15pF
12
DC ACCURACY
Zero Error
Gain Error
Reference Input Resistance
0.8
1.5
800
% FS
% FS
POWER SUPPLY REQUIREMENTS
Supply Voltage: +V
S
Supply Current: +I
S
Power Dissipation
Thermal Resistance,
θ
JA
Operating
Operating
Operating
4.7
5
95
475
75
5.3
102
510
V
mA
mW
C/W
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PDF描述
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