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參數(shù)資料
| 型號： | UPD703212 |
| 廠商： | NEC Corp. |
| 英文描述： | 32-Bit Single-Chip Microcontrollers |
| 中文描述： | 32位單芯片微控制器 |
| 文件頁數(shù)： | 482/757頁 |
| 文件大?。?/td> | 4410K |
| 代理商： | UPD703212 |
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CHAPTER 16 CLOCKED SERIAL INTERFACE 0 (CSI0)
User
’
s Manual U15862EJ3V0UD
482
(7) Clocked serial interface transmission buffer register n (SOTBn)
The SOTBn register is a 16-bit buffer register that stores transmit data.
When the transmission/reception mode is set (TRMDn bit of CSIM0n register = 1), the transmission operation
is started by writing data to the SOTBn register.
This register can be read/written in 16-bit units.
Cautions 1. Access the SOTBn register only when the 16-bit data length is set (CCLn bit of CSIM0n
register = 1).
2. When the single transfer mode is set (AUTOn bit of CSIM0n register = 0), perform
access only in the idle state (CSOTn bit of CSIM0n register = 0). If the SOTBn register is
accessed during data transfer, the data cannot be guaranteed.
14
SOTBn
14
13
SOTBn
13
12
SOTBn
12
2
SOTBn
2
3
SOTBn
3
4
SOTBn
4
5
SOTBn
5
6
SOTBn
6
7
SOTBn
7
8
SOTBn
8
9
SOTBn
9
10
SOTBn
10
11
SOTBn
11
15
SOTBn
15
1
SOTBn
1
0
SOTBn
0
SOTBn
After reset: 0000H R/W Address: FFFFFD04H, FFFFFD14H, FFFFFD24H
Remark
n = 0, 1 (V850ES/KF1, V850ES/KG1), n = 0 to 2 (V850ES/KJ1)
(8) Clocked serial interface transmission buffer register nL (SOTBnL)
The SOTBnL register is an 8-bit buffer register that stores transmit data.
When the transmission/reception mode is set (TRMDn bit of CSIM0n register = 1), the transmission operation
is started by writing data to the SOTBnL register.
These registers can be read/written in 8-bit or 1-bit units.
The SOTBnL register is the same as the lower bytes of the SOTBn register.
Cautions 1. Access the SOTBnL register only when the 8-bit data length has been set (CCLn bit of
CSIM0n register = 0).
2. When the single transfer mode is set (AUTOn bit of CSIM0n register = 0), perform
access only in the idle state (CSOTn bit of CSIM0n register = 0). If the SOTBnL register
is accessed during data transfer, the data cannot be guaranteed.
7
SOTBn7
SOTBnL
6
SOTBn6
5
SOTBn5
4
SOTBn4
3
SOTBn3
2
SOTBn2
1
SOTBn1
0
SOTBn0
After reset: 00H R/W Address: FFFFFD04H, FFFFFD14H, FFFFFD24H
Remark
n = 0, 1 (V850ES/KF1, V850ES/KG1), n = 0 to 2 (V850ES/KJ1)
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PDF描述 |
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