參數(shù)資料
型號(hào)： UPD65966
英文描述： CMOS Gate Array.Embedded Array Ver.2.0 for Package | Design Manual[05/2003]
中文描述： CMOS門陣列Array.Embedded的包版本2.0 |設(shè)計(jì)手冊(cè)[05/2003]
文件頁數(shù)： 54/64頁
文件大?。?/td> 399K
代理商： UPD65966
54
μ
PD64A, 65
Data Sheet U14380EJ2V0DS00
14. PACKAGE DRAWINGS
Remark
The dimensions and materials of the ES model are the same as those of the mass production model.
N
S
C
D
M
M
P
L
U
T
G
F
E
B
K
J
detail of lead end
S
20
11
1
10
A
H
I
20 PIN PLASTIC SSOP (300 mil)
NOTE
Each lead centerline is located within 0.12 mm of
its true position (T.P.) at maximum material condition.
S20MC-65-5A4-1
ITEM
A
B
C
MILLIMETERS
6.65
±
0.15
D
E
F
G
H
I
J
K
L
M
N
0.65 (T.P.)
+
0.08
0.07
1.3
±
0.1
1.2
8.1
±
0.2
6.1
±
0.2
0.475 MAX.
0.13
0.10
0.5
1.0
±
0.2
0.17
±
0.03
0.24
0.1
±
0.05
P
3
°
+
5
°
3
°
0.25
0.6
±
0.15
T
U
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PDF描述
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