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參數(shù)資料
| 型號： | UPD65966 |
| 英文描述： | CMOS Gate Array.Embedded Array Ver.2.0 for Package | Design Manual[05/2003] |
| 中文描述： | CMOS門陣列Array.Embedded的包版本2.0 |設計手冊[05/2003] |
| 文件頁數(shù)： | 52/64頁 |
| 文件大小： | 399K |
| 代理商： | UPD65966 |
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52
μ
PD64A, 65
Data Sheet U14380EJ2V0DS00
12. CHARACTERISTIC CURVE (REFERENCE VALUES)
P
D
Power supply voltage V
DD
[V]
I
DD
vs V
DD
(fx = 4 MHz)
(T
A
= 25
°
C)
1.5
2
3
2.5
3.6
4
0
0.1
0.2
0.3
0.4
0.5
0.6
0.7
0.8
0.9
1
OPERATING mode
HALT mode
1.5
2
3
2.5
3.6
4
0
0.1
0.2
0.3
0.4
0.5
0.6
0.7
0.8
0.9
1
P
D
Power supply voltage V
DD
[V]
I
DD
vs V
DD
(fx = 8 MHz)
(T
A
= 25
°
C)
OPERATING mode
HALT mode
25
20
15
10
5
0
1
2
3
L
O
Low-level output voltage V
OL
[V]
I
OL
vs V
OL
(REM, LED)
(T
A
= 25
°
C, V
DD
= 3.0 V)
20
18
16
14
12
10
8
6
4
2
0
V
DD
V
DD
1
V
DD
2
V
DD
3
H
O
High-level output voltage V
OH
[V]
I
OH
vs V
OH
(REM, LED, K
I/O
)
(T
A
= 25
°
C, V
DD
= 3.0 V)
500
450
400
350
300
250
200
150
100
50
0
1
2
3
L
O
μ
Low-level output voltage V
OL
[V]
I
OL
vs V
OL
(K
I/O
)
(T
A
= 25
°
C, V
DD
= 3.0 V)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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