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參數(shù)資料
| 型號(hào)： | UPD46128953-E15X |
| 廠商： | NEC Corp. |
| 英文描述： | 128M-BIT CMOS MOBILE SPECIFIED RAM 4M-WORD BY 32-BIT ADDRESS / DATA MULTIPLEXED EXTENDED TEMPERATURE OPERATION |
| 中文描述： | 128兆位CMOS移動(dòng)指明內(nèi)存分詞由32位地址/數(shù)據(jù)復(fù)用溫度范圍 |
| 文件頁數(shù)： | 41/60頁 |
| 文件大小： | 468K |
| 代理商： | UPD46128953-E15X |
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Preliminary Data Sheet M17506EJ1V1DS
41
μ
PD46128953-X
AC Specifications
(1/2)
Parameter
Symbol
-E12X
-E15X
Unit
Note
MIN.
MAX.
MIN.
MAX.
Clock Specifications
Cycle frequency
t
CLK
83
66
MHz
CLK HIGH width
t
CH
3
3
ns
CLK LOW width
t
CL
3
3
ns
CLK rise / fall time
t
CHCL
3
3
ns
Address Latching Specifications
Address hold time from /ADV = HIGH
t
AH
1
1
ns
Address setup time to CLK
t
ACS
5
5
ns
Address hold time to CLK
t
ACH
7
7
ns
/ADV = LOW setup time to CLK
t
CSV
5
5
ns
/ADV = LOW hold time from CLK
t
CHV
1
1
ns
Address setup time to /OE = LOW
t
AOS
0
0
ns
/ADV = LOW pulse width
t
VPL
6
6
ns
/ADV = LOW to next /ADV = LOW
t
CVCV
10
10
μ
s
1
Control Signals Specifications
/CE1 setup time to CLK
t
CES
5
5
ns
/CE1 hold time to CLK
t
CEH
1
1
ns
/OE setup time to CLK
t
OES
5
5
ns
/OE hold time to CLK
t
OEH
1
1
ns
/WE setup time to CLK
t
WES
5
5
ns
/WE hold time to CLK
t
WEH
1
1
ns
Note 1.
t
CVCV
(MAX.) is applied while /CE1 is being hold at LOW.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD46128953-X | 128M-BIT CMOS MOBILE SPECIFIED RAM 4M-WORD BY 32-BIT ADDRESS / DATA MULTIPLEXED EXTENDED TEMPERATURE OPERATION |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| UPD4702C-A | 制造商:Renesas Electronics 功能描述:Cut Tape |
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