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參數(shù)資料
| 型號(hào)： | UC62LV4096 |
| 廠(chǎng)商： | Electronic Theatre Controls, Inc. |
| 英文描述： | Low Power CMOS SRAM |
| 中文描述： | 低功耗CMOS SRAM |
| 文件頁(yè)數(shù)： | 6/9頁(yè) |
| 文件大小： | 145K |
| 代理商： | UC62LV4096 |
Low Power CMOS SRAM
256K X 16
UC62LV4096
-55/-70
AC ELECTRICAL CHARACTERISTICS (TA=0
WRITE CYCLE
JEDEC
PARAMETER
NAME
to 70
, VCC=1.5V~3.6V)
UC62LV4096-55
UC62LV4096-70
PARAMETER
NAME
DESCRIPTION
Min
Typ
Max
Min
Typ
Max
UNIT
t
AVAX
t
WC
Write Cycle Time
55
-
-
70
-
-
ns
t
E1LWH
t
CW
Chip Select to END of Write
40
-
-
50
-
-
ns
t
AVWL
t
AS
Address Setup Time
0
-
-
0
-
-
ns
t
AVWH
t
AW
Address valid to End of Write
40
-
-
50
-
-
ns
t
BW
t
BW
Data Byte Control End of Write
40
50
Ns
t
WLWH
t
WP
Write Pulse Width
40
-
-
50
-
-
ns
t
WHAX
t
WR
Write Recovery Time
0
-
-
0
-
-
ns
t
WLOZ
t
WHZ
Write to Output in High Z
-
-
20
-
-
20
ns
t
DVWH
t
DW
Data to Write Time Overlap
35
-
40
-
ns
t
WHDX
t
DH
Data Hold Time for Write End
0
-
-
0
-
-
ns
t
GHOZ
t
OHZ
Output Disable to Output In High Z
-
-
20
-
-
20
ns
t
WHQX
t
OW
End of Write to Output Active
10
-
-
10
-
-
ns
SWITCHING WAVEFORMS (WRITE CYCLE)
WRITECYCLE1
(1)
t
WC
ADDRESS
t
DH
t
OHZ
WE
D
OUT
OE
CE
t
CW
(11)
t
WP
(2)
t
AW
t
AS
(4,10)
D
IN
t
DW
t
BW
UB/LB
U-Chip Technology Corp. LTD.
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PAGE
6
Preliminary
Rev. 1.0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UC62LV4096AC-20 | Low Power CMOS SRAM |
| UC62LV4096AC-25 | Low Power CMOS SRAM |
| UC62LV4096AI-20 | Low Power CMOS SRAM |
| UC62LV4096AI-25 | Low Power CMOS SRAM |
| UC62LV4096JC-20 | Low Power CMOS SRAM |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| UC62LV4096AC-20 | 制造商:未知廠(chǎng)家 制造商全稱(chēng):未知廠(chǎng)家 功能描述:Low Power CMOS SRAM |
| UC62LV4096AC-25 | 制造商:未知廠(chǎng)家 制造商全稱(chēng):未知廠(chǎng)家 功能描述:Low Power CMOS SRAM |
| UC62LV4096AI-20 | 制造商:未知廠(chǎng)家 制造商全稱(chēng):未知廠(chǎng)家 功能描述:Low Power CMOS SRAM |
| UC62LV4096AI-25 | 制造商:未知廠(chǎng)家 制造商全稱(chēng):未知廠(chǎng)家 功能描述:Low Power CMOS SRAM |
| UC62LV4096JC-20 | 制造商:未知廠(chǎng)家 制造商全稱(chēng):未知廠(chǎng)家 功能描述:Low Power CMOS SRAM |
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