參數(shù)資料
型號(hào)： TS68C429AVR
廠商： ATMEL CORP
元件分類： 微控制器/微處理器
英文描述： CMOS ARINC 429 Multichannel Receiver/ Transmitter MRT
中文描述： 3 CHANNEL(S), 2.5M bps, SERIAL COMM CONTROLLER, CPGA84
封裝： PGA-84
文件頁(yè)數(shù)： 11/43頁(yè)
文件大小： 1638K
代理商： TS68C429AVR
11
TS68C429A
2120A–HIREL–08/02
Clock Timing
Note:
1. t
cyc
A
≥
4 x t
cyc
S.
AC Electrical
Characteristics
With V
CC
= 5 V
DC
± 10% V
SS
= 0 V
DC
.
IEIxx, IEOxx, IACKxx, must be understood as generic signals (xx = RX and TX).
Figure 4.
Read Cycle
Notes:
1. LDS/UDS can be asserted on the next or previous CLK-SYS period after CS goes low but (4) must be met for the next
period.
2. The cycle ends when the first of CS, LDS/UDS goes high.
Table 6.
Clock System (CLK SYS)
Symbol
Parameter
Min
Max
Unit
t
cyc
S
Clock Period
50
2000
ns
t
CLS
, t
CHS
Clock Pulse Width
20
ns
t
crS
, t
cfS
Rise and Fall Times
5
ns
Table 7.
Clock ARINC (CLK ARINC)
Symbol
Parameter
Min
Max
Unit
t
cyc
A
Cycle Time
(1)
200
8000
ns
t
CLA
, t
CHA
Clock Pulse Width
240
ns
t
crA
, t
cfA
Rise and Fall Times
5
ns
相關(guān)PDF資料
PDF描述
TS68C429ADESCxx CMOS ARINC 429 Multichannel Receiver/ Transmitter MRT
TS68EN360VR25L 32-bitQuad Integrated Communication Controller
TS68EN360VR33L 32-bitQuad Integrated Communication Controller
TS68EN360DES01MXCL 32-bitQuad Integrated Communication Controller
TS68EN360 32-bitQuad Integrated Communication Controller
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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