XCLKOUT(B) XCLKIN(A) C5 C9 C10 C1 C8 C6 TMS320F280" />
參數(shù)資料
型號： TMX320F28069UPZPA
廠商： Texas Instruments
文件頁數(shù)： 137/174頁
文件大?。?/td> 0K
描述： IC MCU 32BIT 128KB FLSH 100HTQFP
產(chǎn)品培訓(xùn)模塊： ControlSUITE
Piccolo F2806x
TPS75005 Single IC Power for C2000 MCU
標(biāo)準(zhǔn)包裝： 1
系列： TMS320F2806x, Piccolo™, C2000™
核心處理器： C28x
芯體尺寸： 32-位
速度： 80MHz
連通性： CAN，I²C，McBSP，SCI，SPI，UART/USART
外圍設(shè)備： 欠壓檢測/復(fù)位，DMA，POR，PWM，WDT
輸入/輸出數(shù)： 54
程序存儲器容量： 256KB（128K x 16）
程序存儲器類型： 閃存
RAM 容量： 50K x 16
電壓 - 電源 (Vcc/Vdd)： 1.71 V ~ 1.995 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 16x12b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 100-TQFP 裸露焊盤
包裝： 托盤
其它名稱： 296-30086
TMX320F28069UPZPA-ND
C4
C3
XCLKOUT(B)
XCLKIN(A)
C5
C9
C10
C1
C8
C6
SPRS698D – NOVEMBER 2010 – REVISED DECEMBER 2012
5.4
Clock Requirements and Characteristics
Table 5-4. XCLKIN Timing Requirements - PLL Enabled
NO.
MIN
MAX
UNIT
C9
tf(CI)
Fall time, XCLKIN
6
ns
C10
tr(CI)
Rise time, XCLKIN
6
ns
C11
tw(CIL)
Pulse duration, XCLKIN low as a percentage of tc(OSCCLK)
45
55
%
C12
tw(CIH)
Pulse duration, XCLKIN high as a percentage of tc(OSCCLK)
45
55
%
Table 5-5. XCLKIN Timing Requirements - PLL Disabled
NO.
MIN
MAX
UNIT
C9
tf(CI)
Fall time, XCLKIN
Up to 20 MHz
6
ns
20 MHz to 90 MHz
2
C10
tr(CI)
Rise time, XCLKIN
Up to 20 MHz
6
ns
20 MHz to 90 MHz
2
C11
tw(CIL)
Pulse duration, XCLKIN low as a percentage of tc(OSCCLK)
45
55
%
C12
tw(CIH)
Pulse duration, XCLKIN high as a percentage of tc(OSCCLK)
45
55
%
The possible configuration modes are shown in Table 2-17.
Table 5-6. XCLKOUT Switching Characteristics (PLL Bypassed or Enabled)(1)(2)
over recommended operating conditions (unless otherwise noted)
NO.
PARAMETER
MIN
MAX
UNIT
C3
tf(XCO)
Fall time, XCLKOUT
ns
C4
tr(XCO)
Rise time, XCLKOUT
ns
C5
tw(XCOL)
Pulse duration, XCLKOUT low
H – 2
H + 2
ns
C6
tw(XCOH)
Pulse duration, XCLKOUT high
H – 2
H + 2
ns
(1)
A load of 40 pF is assumed for these parameters.
(2)
H = 0.5tc(XCO)
A.
The relationship of XCLKIN to XCLKOUT depends on the divide factor chosen. The waveform relationship shown is
intended to illustrate the timing parameters only and may differ based on actual configuration.
B.
XCLKOUT configured to reflect SYSCLKOUT.
Figure 5-3. Clock Timing
Copyright 2010–2012, Texas Instruments Incorporated
Peripheral and Electrical Specifications
65
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