參數(shù)資料
型號(hào)： ST5x86
廠商： 意法半導(dǎo)體
英文描述： 100 and 120 MHz 3.45 Volt 5x86 CPU(微處理器)
中文描述： 100和120兆赫3.45伏特5x86的CPU（微處理器）
文件頁數(shù)： 10/39頁
文件大?。?/td> 326K
代理商： ST5X86
ST5x86
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Figure 1.6. Configuration Control Register 4 (CCR4)
Table 1.6. CCR4 Bit Definitions
BIT
POSITION
NAME
DESCRIPTION
2-0
IORT[2-0]
I/O Recovery Time
Specifies the minimum number of bus clocks between I/O accesses:
0h = no clock delay
1h = 2-clock delay
2h = 4-clock delay
3h = 8-clock delay
4h = 16-clock delay
5h = 32-clock delay (default value after RESET)
6h = 64-clock delay
7h = 128-clock delay
3
MEM_BYP
If = 1: Memory read bypassing is enabled.
If = 0: Memory read bypassing is disabled.
4
DTE_EN
Enable Directory Table Entry Cache
If = 1: the Directory Table Entry cache is enabled.
If = 0: the Directory Table Entry cache is disabled.
Note:
Bits 0-4 are cleared to zero at reset, bits5-7 are reserved.
相關(guān)PDF資料
PDF描述
ST62 SERIES 8-Bit OTP/EPROM MCUs with A/D Converter, Oscilator Safeguard, Safe Reset and 20 Pins(8位OTP/EPROM微控制器(8M))
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ST6200LM1 LOW VOLTAGE 8-BIT ROM MCUs WITH A/D CONVERTER,AND 16 PINS
ST6201LM1 LOW VOLTAGE 8-BIT ROM MCUs WITH A/D CONVERTER,AND 16 PINS
ST6203L LOW VOLTAGE 8-BIT ROM MCUs WITH A/D CONVERTER,AND 16 PINS
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參數(shù)描述
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