參數(shù)資料
型號(hào)： SSTUG32865ET/S
廠商： NXP SEMICONDUCTORS
元件分類： 鎖存器
英文描述： SSTU SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PBGA160
封裝： 9 X 13 MM, 0.70 MM PITCH, LEAD FREE, PLASTIC, SOT-802-2, TFBGA-160
文件頁(yè)數(shù)： 10/28頁(yè)
文件大?。?/td> 154K
代理商： SSTUG32865ET/S
SSTUG32865_1
NXP B.V. 2007. All rights reserved.
Product data sheet
Rev. 01 — 16 August 2007
18 of 28
NXP Semiconductors
SSTUG32865
1.8 V DDR2-1G registered buffer with parity
11. Test information
11.1 Test circuit
All input pulses are supplied by generators having the following characteristics:
Pulse Repetition Rate (PRR)
≤ 10 MHz; Z
0 =50 ; input slew rate = 1 V/ns ± 20 %,
unless otherwise specied.
The outputs are measured one at a time with one transition per measurement.
(1) CL includes probe and jig capacitance.
Fig 8.
Load circuit
(1) IDD tested with clock and data inputs held at VDD or GND, and IO = 0 mA.
Fig 9.
Voltage and current waveforms; inputs active and inactive times
VID = 600 mV.
VIH =Vref + 250 mV (AC voltage levels) for differential inputs. VIH =VDD for LVCMOS inputs.
VIL =Vref 250 mV (AC voltage levels) for differential inputs. VIL = GND for LVCMOS inputs.
Fig 10. Voltage waveforms; pulse duration
RL = 100
RL = 1000
VDD
50
CK inputs
CK
OUT
DUT
test point
002aaa371
test point
delay = 350 ps
Zo = 50
RL = 1000
CL = 30 pF(1)
LVCMOS
RESET
10 %
IDD(1)
tINACT
VDD
0.5VDD
tACT
90 %
0 V
002aaa372
0.5VDD
VICR
VIH
VIL
input
tW
VID
002aaa373
相關(guān)PDF資料
PDF描述
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SSTUG32866EC/S 制造商:PHILIPS 制造商全稱:NXP Semiconductors 功能描述:1.8 V 25-bit 1 : 1 or 14-bit 1 : 2 configurable registered buffer
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