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參數(shù)資料
| 型號(hào)： | SPAK56853FG120 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 數(shù)字信號(hào)處理 |
| 英文描述： | 16-BIT, 4 MHz, OTHER DSP, PQFP128 |
| 封裝： | LQFP-128 |
| 文件頁數(shù)： | 364/649頁 |
| 文件大小： | 7965K |
| 代理商： | SPAK56853FG120 |
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Servicing the Host Interface
MOTOROLA
Host Interface Eight (HI8)
16-33
Preliminary
16
16.10.9.4 DSP-to-Host Processor Procedure
The following procedure outlines the typical steps that the Host Processor must take to
setup and terminate a DSP-to-Host DMA transfer.
1. Setup the external DMA controller destination address, direction, byte count, and
other control registers. Enable the DMA controller channel.
2. The DSP must be configured to provide the outgoing data via polling, interrupts, or
DSP Side DMA configuration. If interrupt operation is desired HTIE must be set to
enable the HTDE interrupt. If DSP Side DMA operations are desired, set TDMAE
to enable DSP transfers when HTDE is set. This could be done with a separate Host
Command exception routine in the DSP.
3. Set HTDE and clear RXDF. This can be done with the appropriate INIT function.
The DSP Host transmit exception is activated immediately by DSP hardware which
begins the DMA transfer.
4. Perform other tasks until interrupted by the DMA controller DMA complete
interrupt. The DSP Interface Control Register (ICR), the Interrupt Status Register
(ISR), and TXH/TXL may be accessed at any time by the Host Processor (using
HA0-HA2, HRW/HRD, HDS/HWR, and HCS) but the receive byte registers (RXH
and RXL) may not be accessed until the DMA mode is disabled.
5. Terminate the DMA controller channel to disable DMA transfers.
6. Terminate the DSP HI8 DMA mode by clearing the HM1 and HM0 bits and
clearing RREQ in the Interface Control Register (ICR).
16.10.10 Host Port Use Considerations
Careful synchronization is required when reading multi-bit registers written by another
asynchronous system. This is a common problem when two asynchronous systems are
connected. The situation exists in the Host port. However, if the port is used in the way it
was designed, proper operation is guaranteed. The considerations for proper operation are
discussed below.
16.10.10.1 Host Programmer Considerations
1. Unsynchronized Reading of receive byte registers.
When reading receive byte registers, RXH or RXL, the Host programmer should
use interrupts or poll the RXDF flag which indicates that data is available. This
guarantees the data in the receive byte registers are stable.
2. Overwriting transmit byte registers.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SPAK56855BU120 | 16-BIT, 4 MHz, OTHER DSP, PQFP100 |
| SPAK56854FG120 | 16-BIT, 4 MHz, OTHER DSP, PQFP128 |
| SPAK56F802TA60 | 0-BIT, 60 MHz, OTHER DSP, PQFP32 |
| SPAK56F805FV80 | 16-BIT, 8 MHz, OTHER DSP, PQFP144 |
| SPAK56F807VF80 | 16-BIT, 80 MHz, OTHER DSP, PBGA160 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| SPAK56854FG120 | 制造商:Freescale Semiconductor 功能描述: |
| SPAK56857BU120 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:120 MIPS Hybrid Processor |
| SPAK56F803BU80 | 制造商:Freescale Semiconductor 功能描述: |
| SPAK56F805FV80 | 制造商:Freescale Semiconductor 功能描述: |
| SPAKDSP303AG100 | 功能描述:數(shù)字信號(hào)處理器和控制器 - DSP, DSC SPAKDSP303AG100 RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時(shí)鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時(shí)器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT |
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