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參數(shù)資料
| 型號： | SPAK56853FG120 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | 16-BIT, 4 MHz, OTHER DSP, PQFP128 |
| 封裝： | LQFP-128 |
| 文件頁數(shù)： | 183/649頁 |
| 文件大?。?/td> | 7965K |
| 代理商： | SPAK56853FG120 |
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SPI Register Descriptions (SPI_BASE = $1FFFE8)
MOTOROLA
Serial Peripheral Interface (SPI)
11-23
Preliminary
11
11.11.1.2 Data Shift Order (DSO)—Bit 12
This read/write bit determines whether the MSB or LSB bit is transmitted or received first.
Both Master and Slave SPI modules must transmit and receive the same length packets.
Regardless how this bit is set, when reading from the SPDRR or writing to the SPDTR,
the LSB will always be at bit location zero. If the data length is less than 16 bits, the data
will be zero padded on the upper bits.
0 = MSB transmitted first (MSB > LSB)
1 = LSB transmitted first (LSB > MSB)
11.11.1.3 Error Interrupt Enable (ERRIE)—Bit 11
This read/write bit enables the MODF and OVRF bits to generate interrupt requests. Reset
clears the ERRIE bit. The Error Interrupt Enable (ERRIE) bit enables both the MODF and
OVRF bits to generate a receiver/error interrupt request.
0 = MODF and OVRF cannot generate interrupt requests
1 = MODF and OVRF can generate interrupt requests
11.11.1.4 Mode Fault Enable (MODFEN)—Bit 10
This read/write bit, when set to one, allows the MODF flag to be set. If the MODF flag is
set, clearing the MODFEN does not clear the MODF flag.
If the MODFEN bit is low, the level of the SS pin does not affect the operation of an
enabled SPI configured as a master. For an enabled SPI configured as a slave, having
MODFEN low only prevents the MODF flag from being set. If configured as a Master and
MODFEN = 1, a transmission in progress will stop if SS goes low. It does not affect any
other part of SPI operation.
The Mode Fault Enable (MODFEN) bit can retard the MODF flag from being set. The
retarded bit results in only the OVRF bit being enabled by the ERRIE bit. This enabling
generates receiver/error interrupt requests.
11.11.1.5 SPI Receiver Interrupt Enable (SPRIE)—Bit 9
This read/write bit enables interrupt requests generated by the SPRF bit. The SPRF bit is
set when a full data length transfers from the Shift Register to the Receive Data Register.
The SPI Receiver Interrupt Enable (SPRIE) bit enables the SPRF bit to generate receiver
interrupt requests regardless of the state of the SPE bit. The clearing mechanism for the
SPRF flag is always just a read to the Receive Data Register.
0 = SPRF interrupt requests disabled
1 = SPRF interrupt requests enabled
相關PDF資料 |
PDF描述 |
|---|---|
| SPAK56855BU120 | 16-BIT, 4 MHz, OTHER DSP, PQFP100 |
| SPAK56854FG120 | 16-BIT, 4 MHz, OTHER DSP, PQFP128 |
| SPAK56F802TA60 | 0-BIT, 60 MHz, OTHER DSP, PQFP32 |
| SPAK56F805FV80 | 16-BIT, 8 MHz, OTHER DSP, PQFP144 |
| SPAK56F807VF80 | 16-BIT, 80 MHz, OTHER DSP, PBGA160 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| SPAK56854FG120 | 制造商:Freescale Semiconductor 功能描述: |
| SPAK56857BU120 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:120 MIPS Hybrid Processor |
| SPAK56F803BU80 | 制造商:Freescale Semiconductor 功能描述: |
| SPAK56F805FV80 | 制造商:Freescale Semiconductor 功能描述: |
| SPAKDSP303AG100 | 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC SPAKDSP303AG100 RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風格:SMD/SMT |
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