參數(shù)資料
型號(hào)： SM8212
廠商： Seiko NPC Corporation
英文描述： POCSAG Decoder For Multiframe Pagers
中文描述： POCSAG碼解碼器多幀尋呼機(jī)
文件頁(yè)數(shù)： 3/32頁(yè)
文件大?。?/td> 167K
代理商： SM8212
NIPPON PRECISION CIRCUITS-3
SM8212B
Pin number
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
Pin name
BS1
BS2
BS3
SIGNAL
XVSS
XT
XTN
VSS
CLKO
RSTN
AREA
SCK
SDO
SDI
ATTN
VDD
i/o
o
o
o
i
-
i
o
-
o
i
o
i
o
i
o
-
Description
RF control main output signal
RF DC-level adjustment signal
PLL setup signal
NRZ signal input pin
Crystal oscillator ground. Capacitor connected between XVSS and VDD
Oscillator input pin
Oscillator output pin
Ground
76.8 or 38.4 kHz clock output
Hardware clear (reset)
Sync code detection output (HIGH for minimum 1 sec. on detection)
CPU-to-decoder data transfer sync clock
Status and received data output to CPU
Data input from CPU (including ID data)
Interrupt detect signal output pin (Ready for data transmission when LOW)
Supply voltage
i = Input,
o = Output
SM8212B Paging Receiver Block Diagram
RF
Waveform
Recovery
POCSAG
Decoder
SM8212
SP
Melody
IC
PLL Circuit
CPU Unit
ID
ROM
D/D Converter
LCD Driver
LCD
Supply Unit
Alert
PIN DESCRIPTION
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PDF描述
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