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參數(shù)資料
| 型號： | SC16C852VIET,157 |
| 廠商： | NXP Semiconductors |
| 文件頁數(shù)： | 39/55頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC UART DUAL W/FIFO 36TFBGA |
| 產(chǎn)品培訓模塊： | Stand-Alone UARTs |
| 標準包裝： | 2,450 |
| 特點： | 可編程 |
| 通道數(shù)： | 2，DUART |
| FIFO's： | 128 字節(jié) |
| 規(guī)程： | RS485 |
| 電源電壓： | 2.5V |
| 帶自動流量控制功能： | 是 |
| 帶IrDA 編碼器/解碼器： | 是 |
| 帶故障啟動位檢測功能： | 是 |
| 帶調(diào)制解調(diào)器控制功能： | 是 |
| 帶CMOS： | 是 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 36-TFBGA |
| 供應(yīng)商設(shè)備封裝： | 36-TFBGA（3.5x3.5） |
| 包裝： | 托盤 |
| 其它名稱： | 568-4019 935282518157 SC16C852VIET SC16C852VIET-ND |
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SC16C852V
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NXP B.V. 2011. All rights reserved.
Product data sheet
Rev. 5 — 21 January 2011
44 of 55
NXP Semiconductors
SC16C852V
Dual UART with 128-byte FIFOs, IrDA, and XScale VLIO bus interface
Fig 16. Receive ready timing in FIFO mode
D0
D1
D2
D3
D4
D5
D6
D7
002aac360
first byte that
reaches the
trigger level
stop
bit
parity
bit
td(stop-RXRDY)
RXA, RXB
RXRDYA
IOR
active data
ready
start
bit
data bits (0 to 7)
active
td(IOR-RXRDYH)
RXRDYB
Fig 17. Transmit timing
active
transmitter ready
active
16 baud rate clock
002aac361
td(IOW-INTL)
INTA, INTB
IOW
active
D0
D1
D2
D3
D4
D5
D6
D7
TXA, TXB
5 data bits
6 data bits
7 data bits
stop
bit
parity
bit
start
bit
data bits (0 to 7)
next
data
start
bit
td(start-INT)
td(IOW-TX)
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PDF描述 |
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參數(shù)描述 |
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