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參數(shù)資料
| 型號： | SAK-C167CR-LM |
| 廠商： | SIEMENS A G |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-Bit CMOS Single-Chip Microcontroller |
| 中文描述： | 16-BIT, 20 MHz, MICROCONTROLLER, PQFP144 |
| 文件頁數(shù)： | 58/67頁 |
| 文件大小： | 809K |
| 代理商： | SAK-C167CR-LM |
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C167CR
Semiconductor Group
55
1)
RW-delay and
t
A
refer to the next following bus cycle.
ALE rising edge after RD,
WR
t
26
CC
– 10 +
t
F
–
– 10
+
t
F
0
+
t
F
–5 –
t
A
–
–
ns
Address hold after RD,
WR
t
28
CC
0 +
t
F
–
–
ns
ALE falling edge to CS
t
38
t
39
CC
– 5 –
t
A
–
10 –
t
A
55
+
t
C
+
2
t
A
–
10 –
t
A
3TCL – 20
+
t
C
+
2
t
A
–
ns
CS low to Valid Data In
SR
ns
CS hold after RD, WR
t
41
CC
10 +
t
F
TCL – 15
+
t
F
TCL – 5
+
t
A
ns
ALE falling edge to
RdCS, WrCS (with RW-
delay)
t
42
CC
20 +
t
A
–
–
ns
ALE falling edge to
RdCS, WrCS (no RW-
delay)
t
43
CC
– 5 +
t
A
–
– 5
+
t
A
–
ns
RdCS to Valid Data In
(with RW-delay)
t
46
SR
–
25 +
t
C
–
2TCL – 25
+
t
C
3TCL – 25
+
t
C
–
ns
RdCS to Valid Data In
(no RW-delay)
t
47
SR
–
50 +
t
C
–
ns
RdCS, WrCS Low Time
(with RW-delay)
t
48
CC
40 +
t
C
–
2TCL – 10
+
t
C
3TCL – 10
+
t
C
2TCL – 15
+
t
C
0
ns
RdCS, WrCS Low Time
(no RW-delay)
t
49
CC
65 +
t
C
–
–
ns
Data valid to WrCS
t
50
CC
35 +
t
C
–
–
ns
Data hold after RdCS
t
51
t
53
SR
0
–
30 +
t
F
–
ns
Data float after RdCS
(with RW-delay)
SR
–
–
2TCL – 20
+
t
F
TCL – 20
+
t
F
–
ns
Data float after RdCS
(no RW-delay)
t
68
SR
–
5 +
t
F
–
ns
Address hold after
RdCS, WrCS
t
55
CC
– 10 +
t
F
–
– 10
+
t
F
TCL – 15
+
t
F
ns
Data hold after WrCS
t
57
CC
10 +
t
F
–
–
ns
Parameter
Symbol
Max. CPU Clock
= 20 MHz
Variable CPU Clock
1/2TCL = 1 to 20 MHz
Unit
min.
max.
min.
max.
相關(guān)PDF資料 |
PDF描述 |
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| SAK-C167CS-4RM | 16-Bit Single-Chip Microcontroller |
| SAK-C167CS-LM | 16-Bit Single-Chip Microcontroller |
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參數(shù)描述 |
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| SAK-C167CR-LM-ES-HA | 制造商:Infineon Technologies AG 功能描述: |
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| SAKC167CRLM-GAT6 | 制造商:Infineon Technologies AG 功能描述:MCU 16-Bit C166 CISC/RISC ROMLess 5V 144-Pin MQFP |
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