- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄25635 > S83C154DXXX-30D (TEMIC SEMICONDUCTORS) 8-BIT, MROM, 30 MHz, MICROCONTROLLER, PQCC44 PDF資料下載
參數(shù)資料
| 型號： | S83C154DXXX-30D |
| 廠商： | TEMIC SEMICONDUCTORS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 30 MHz, MICROCONTROLLER, PQCC44 |
| 文件頁數(shù)： | 815/1021頁 |
| 文件大?。?/td> | 15196K |
| 代理商： | S83C154DXXX-30D |
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812
32072H–AVR32–10/2012
AT32UC3A3
30.4
Product Dependencies
In order to use this module, other parts of the system must be configured correctly, as described
below.
30.4.1
Clocks
The clock for the BUSMON bus interface (CLK_BUSMON) is generated by the Power Manager.
This clock is enabled at reset and can be disabled in the Power Manager. It is recommended to
disable the BUSMON before disabling the clock, to avoid freezing the BUSMON in an undefined
state.
30.5
Functional Description
Three different parameters can be measured by each channel:
The number of data transfer cycles since last channel reset
The number of stall cycles since last channel reset
The maximum continuous number of stall cycles since last channel reset (This approximates
the max latency in the transfers.)
These measurements can be extracted by software and used to generate indicators for bus
latency, bus load and maximum bus latency.
Each of the counters have a fixed width, and may therefore overflow. When overflow is encoun-
tered in either the Channel n Data Cycles (DATAn) register or the Channel n Stall Cycles
(STALLn) register of a channel, all registers in the channel are reset. This behavior is altered if
the Channel n Overflow Freeze (CHnOF) bit is set in the Control (CONTROL) register. If this bit
is written to one, the channel registers are frozen when either DATAn or STALLn reaches its
maximum value. This simplifies one-shot readout of the counter values.
The registers can also be manually reset by writing to the CONTROL register. The Channeln
Max Initiation Latency (LATn) register is saturating, when its max count is reached, it will be set
to its maximum value. The LATn register is reset whenever DATAn and STALLn are reset.
A counter must manually be enabled by writing to the CONTROL register.
相關PDF資料 |
PDF描述 |
|---|---|
| S80C32-40SHXXX:RD | 8-BIT, 40 MHz, MICROCONTROLLER, PQCC44 |
| S80C52CXXX-12SHXXX | 8-BIT, MROM, 12 MHz, MICROCONTROLLER, PQCC44 |
| SC80C52XXX-12SV | 8-BIT, MROM, 12 MHz, MICROCONTROLLER, CDIP40 |
| S80C32XXX-40R | 8-BIT, 40 MHz, MICROCONTROLLER, PQCC44 |
| S83C154DCXXX-16R | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, PQCC44 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| S83C154-L16 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller |
| S83C154T-12 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller |
| S83C154T-16 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller |
| S83C154T-20 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller |
| S83C154T-25 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller |
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