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參數(shù)資料
| 型號(hào)： | S80C32-L16SHXXX |
| 廠商： | ATMEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, 16 MHz, MICROCONTROLLER, PQCC44 |
| 封裝： | PLASTIC, LCC-44 |
| 文件頁數(shù)： | 251/313頁 |
| 文件大?。?/td> | 4988K |
| 代理商： | S80C32-L16SHXXX |
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42
32000D–04/2011
AVR32
5.2.3
Page Table Organization
The MMU leaves the page table organization up to the OS software. Since the page table han-
dling and TLB handling is done in software, the OS is free to implement different page table
organizations. It is recommended, however, that the page table entries (PTEs) are of the format
shown in Figure 5-4. This allows the loaded PTE to be written directly into TLBELO, without the
need for reformatting. How the PTEs are indexed and organized in memory is left to the OS.
Figure 5-4.
Recommended Page Table Entry format
5.2.4
TLB organization
The TLB is used as a cache for the page table, in order to speed up the virtual memory transla-
tion process. Up to two TLBs can be implemented, each with up to 64 entries. Each TLB is
configured as shown in Figure 5-5 on page 42.
Figure 5-5.
TLB organization
The D, W and AP[1] bits are not implemented in ITLBs, since they have no meaning there.
The AP[0] bits are not implemented in DTLBs, since they have no meaning there.
The A bit is the Accessed bit. This bit is set when the TLB entry is loaded with a new value using
the tlbw instruction. It is cleared whenever the TLB matching process finds a match in the spe-
cific TLB entry. The A bit is used to implement pseudo-LRU replacement algorithms.
When an address look-up is performed by the TLB, the address section is searched for an entry
matching the virtual address to be accessed. The matching process is described in chapter
G
D
PFN
C
B
0
9
10
31
SZ
AP
W
876
4 3 2 1
VPN[21:0]
ASID[7:0]
G
D
PFN[21:0]
C
B
V
AP[2:0]
W
Entry 0
VPN[21:0]
ASID[7:0]
G
D
PFN[21:0]
C
B
V
AP[2:0]
W
Entry 1
VPN[21:0]
ASID[7:0]
G
W
PFN[21:0]
C
B
V
AP[2:0]
D
Entry 2
VPN[21:0]
ASID[7:0]
G
W
PFN[21:0]
C
B
V
AP[2:0]
D
Entry 3
VPN[21:0]
ASID[7:0]
G
W
PFN[21:0]
C
B
V
AP[2:0]
D
Entry 63
Address section
Data section
SZ[1:0]
A
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| S8890-15 | AVALANCHE PHOTO DIODE |
| S908QC16CDRER | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PDSO28 |
| MC908QC16CDRE | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PDSO28 |
| MC908QC16CDTE | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PDSO16 |
| S912XDP512F0VPV | 16-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP112 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| S80C376CB8 WAF | 制造商:Intel 功能描述: |
| S80C42 | 制造商:Intel 功能描述: |
| S80C51 WAF | 制造商:Intel 功能描述: |
| S80C51-12 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller |
| S80C51-16 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller |
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