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參數(shù)資料
| 型號： | S3P72M9-QA |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 4-BIT, OTPROM, 6 MHz, MICROCONTROLLER, PQFP128 |
| 封裝： | 14 X 20 MM, QFP-128 |
| 文件頁數(shù)： | 4/265頁 |
| 文件大?。?/td> | 1133K |
| 代理商： | S3P72M9-QA |
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S3C72M5/C72M7/C72M9/P72M9 (Preliminary Spec)
MEMORY MAP
4-49
WMOD —Watch Timer Mode Register
WT
F89H, F88H
Bit
7
6
5
4
3
2
1
0
Identifier
.7
"0"
.5
.4
.3
.2
.1
.0
RESET Value
0
(note)
0
Read/Write
W
R
W
Bit Addressing
8
1
8
WMOD.7
Enable/Disable Buzzer Output Bit
0
Disable buzzer (BUZ) signal output
1
Enable buzzer (BUZ) signal output
WMOD.6
Bit 6
0
Always logic zero
WMOD.5–.4
Output Buzzer Frequency Selection Bits
0
2 kHz buzzer (BUZ) signal output
0
1
4 kHz buzzer (BUZ) signal output
1
0
8 kHz buzzer (BUZ) signal output
1
16 kHz buzzer (BUZ) signal output
WMOD.3
XT
IN Input Level Control Bit
0
Input level to XT
IN pin is low; 1-bit read-only addressable for tests
1
Input level to XT
IN pin is high; 1-bit read-only addressable for tests
WMOD.2
Enable/Disable Watch Timer Bit
0
Disable watch timer and clear frequency dividing circuits
1
Enable watch timer
WMOD.1
Watch Timer Speed Control Bit
0
Normal speed; set IRQW to 0.5 seconds
1
High-speed operation; set IRQW to 3.91 ms
WMOD.0
Watch Timer Clock Selection Bit
0
Select main system clock (fx)/128 as the watch timer clock
1
Select a subsystem clock as the watch timer clock
NOTE: RESET sets WMOD.3 to the current input level of the subsystem clock, XTin. If the input level is high, WMOD.3
is set to logic one; if low, WMOD.3 is cleared to zero along with all the other bits in the WMOD register.
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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