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參數(shù)資料
| 型號(hào)： | S3P72M9-QA |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 4-BIT, OTPROM, 6 MHz, MICROCONTROLLER, PQFP128 |
| 封裝： | 14 X 20 MM, QFP-128 |
| 文件頁數(shù)： | 128/265頁 |
| 文件大?。?/td> | 1133K |
| 代理商： | S3P72M9-QA |
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S3C72M5/C72M7/C72M9/P72M9 (Preliminary Spec)
LCD CONTROLLER/DRIVER
12-7
Table 12-5. LCD Mode Register (LMOD) Organization
Segment/Port Output Selection Bits
LMOD.7
LMOD.6
LMOD.5
LMOD.4
The state of SEG or normal I/O port
(SEG79/P6.0 – SEG48/P13.3)
Total Number of
Segment
(1/8 duty, 1/16 duty)
0
P6–13; SEG port
88, 80
0
1
P7–13; SEG port, P6; normal I/O port
84, 76
0
1
0
P8–13; SEG port, P6, 7; normal I/O port
80, 72
0
1
P9–13; SEG port, P6, 7, 8; normal I/O port
76, 68
0
1
0
P10–13; SEG port, P6–9; normal I/O port
72, 64
0
1
0
1
P11–13; SEG port, P6–10; normal I/O port
68, 60
0
1
0
P12, 13; SEG port, P6–11; normal I/O port
64, 56
0
1
P13; SEG port, P6–12; normal I/O port
60, 52
1
0
P6–13; normal I/O port
51, 48
NOTE: Segment pins that can be used for normal I/O should be configured to output mode for the SEG function.
LCD Clock Selection Bits
LMOD.3
LMOD.2
LCD Clock (LCDCK)
1/8 duty (COM0–COM7)
1/16 duty (COM0–COM15)
0
fxx/27 (256 Hz)
fxx/26 (512 Hz)
0
1
fxx/26 (512 Hz)
fxx/25 (1024 Hz)
1
0
fxx/25 (1024 Hz)
fxx/24 (2048 Hz)
1
fxx/24 (2048 Hz)
fxx/23 (4096 Hz)
NOTE: LCDCK is supplied only when the watch timer operates. To use the LCD controller, bit 2 in the watch mode register
WMOD should be set to 1.
Display Mode Selection Bits
LMOD.1
LMOD.0
Function
0
All LCD dots off
0
1
All LCD dots on
1
Normal display
相關(guān)PDF資料 |
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