參數(shù)資料
型號： R5F5630DCDFC#V0
廠商： Renesas Electronics America
文件頁數(shù)： 45/165頁
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描述： MCU RX630 1.5MB FLASH 176LQFP
產(chǎn)品培訓模塊： RX Compare Match Timer
RX DMAC
標準包裝： 1
系列： RX600
核心處理器： RX
芯體尺寸： 32-位
速度： 100MHz
連通性： CAN，EBI/EMI，I²C，LIN，SCI，SPI，USB
外圍設備： DMA，LVD，POR，PWM，WDT
輸入/輸出數(shù)： 148
程序存儲器容量： 1.5MB（1.5M x 8）
程序存儲器類型： 閃存
RAM 容量： 128K x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x10b，21x12b，D/A 2x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 176-LQFP
包裝： 托盤
R01DS0060EJ0100 Rev.1.00
Page 139 of 168
Sep 13, 2011
RX630 Group
5. Electrical Characteristics
Note 1. The value within parentheses is applicable when the value of the ICMR3.NF[1:0] bits is 11b while the digital filter is enabled by
the setting ICFER.NFE = 1.
Note 2. Cb is the total capacitance of the bus lines.
Table 5.18
Timing of On-Chip Peripheral Modules (4)
Conditions: VCC = AVCC0 = VCC_USB = 2.7 to 3.6 V, VREFH/VREFH0 = 2.7 V to AVCC0
VSS = AVSS0 = VREFL/VREFL0 = VSS_USB = 0 V
PCLK = 8 to 50 MHz
Ta = Topr
High drive output is selected by the drive capacity control register.
Item
Symb
ol
Min.*1,*2
Max.
Unit
Test
Conditions
RIIC
(Standard-mode,
SMBus)
ICFER.FMPE = 0
SCL input cycle time
tSCL
8(10) × (1/PCLK) +
1300
—
ns
SCL input high pulse width
tSCLH
3(5) × (1/PCLK) + 300
—
ns
SCL input low pulse width
tSCLL
5 × (1/PCLK) + 1000
—
ns
SCL, SDA input rise time
tSr
—
1000
ns
SCL, SDA input fall time
tSf
—
300
ns
SCL, SDA input spike pulse removal time
tSP
0
2 × (1/PCLK)
ns
SMR.CKS
[1:0] = 00b,
SNFR.NFCS
[2:0] = 001b
SDA input bus free time
tBUF
5 × (1/PCLK) + 1000
—
ns
Start condition input hold time
tSTAH
3 (5) × (1/PCLK) + 300
—
ns
Restart condition input setup time
tSTAS
5 × (1/PCLK) + 1000
—
ns
Stop condition input setup time
tSTOS
3 (5) × (1/PCLK) + 300
—
ns
Data input setup time
tSDAS
250
—
ns
Data input hold time
tSDAH
0—
ns
SCL, SDA capacitive load
Cb
—
400
pF
RIIC
(Fast-mode)
SCL input cycle time
tSCL
8 (10) × (1/PCLK) +
600
—
ns
SCL input high pulse width
tSCLH
3 (5) × (1/PCLK) + 300
—
ns
SCL input low pulse width
tSCLL
5 × (1/PCLK) + 300
—
ns
SCL, SDA input rise time
tSr
20 + 0.1Cb
300
ns
SCL, SDA input fall time
tSf
20 + 0.1Cb
300
ns
SCL, SDA input spike pulse removal time
tSP
0
2 × (1/PCLK)
ns
SMR.CKS
[1:0] = 00b,
SNFR.NFCS
[2:0] = 001b
SDA input bus free time
tBUF
5 × (1/PCLK) + 300
—
ns
Start condition input hold time
tSTAH
3 (5) × (1/PCLK) + 300
—
ns
Restart condition input setup time
tSTAS
5 × (1/PCLK) + 300
—
ns
Stop condition input setup time
tSTOS
3 (5) × (1/PCLK) + 300
—
ns
Data input setup time
tSDAS
100
—
ns
Data input hold time
tSDAH
0—
ns
SCL, SDA capacitive load
Cb
—
400
pF
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PDF描述
VI-BW0-IW-F4 CONVERTER MOD DC/DC 5V 100W
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參數(shù)描述
R5F5630DCDFP 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:Renesas MCUs
R5F5630DCDFP#V0 制造商:Renesas Electronics Corporation 功能描述:RX630 1.5MB/128K 100LQFP - Trays 制造商:Renesas Electronics Corporation 功能描述:IC MCU 32BIT 1.5MB FLASH 100LQFP
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R5F5630DCDLC 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:Renesas MCUs
R5F5630DCDLC#U0 制造商:Renesas Electronics Corporation 功能描述:RX630 1.5MB/128KB LGA177 100MHZ - Trays 制造商:Renesas Electronics Corporation 功能描述:IC MCU 32BIT 1.5MB 128KB 177LGA
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