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參數(shù)資料
| 型號(hào)： | R5F2136CSDFP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | FLASH, 20 MHz, MICROCONTROLLER, PQFP64 |
| 封裝： | 10 X 10 MM, 0.50 MM PITCH, PLASTIC, LQFP-64 |
| 文件頁(yè)數(shù)： | 115/766頁(yè) |
| 文件大小： | 7785K |
| 代理商： | R5F2136CSDFP |
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R8C/36T-A Group
13. DTC
Under development Preliminary document
Specifications in this document are tentative and subject to change.
R01UH0240EJ0010 Rev.0.10
Page 170 of 728
Aug 05, 2011
13.3
Operation
13.3.1
Overview
When the DTC is activated, control data (1) is read from the DTC control data area to perform data transfers and
control data after data transfer is written back to the DTC control data area. Twenty-four sets of control data can
be stored in the DTC control data area, which allows 24 types of data transfers to be performed.
There are two transfer modes: normal mode and repeat mode. When the CHNE bit in the DTCCRj (j = 0 to 23)
register is set to 1 (chain transfers enabled), multiple control data is read and data transfers are continuously
performed by one activation source (chain transfers).
A transfer source address is specified by the 16-bit register DTSARj, and a transfer destination address is
specified by the 16-bit register DTDARj. The values in the registers DTSARj and DTDARj are separately fixed
or incremented according to the control data on completion of the data transfer.
Note:
1. For details on control data, refer to 13.2.3 DTC Control Register j (DTCCRj) (j = 0 to 23) to 13.2.8
13.3.2
Activation Sources
The DTC is activated by an interrupt source. Figure 13.2 is a Block Diagram Showing Control of DTC
The interrupt sources to activate the DTC are selected with the DTCENi (i = 0 to 3, 5, or 6) registers.
The DTC sets 0 (activation disabled) to the corresponding bit among bits DTCENi0 to DTCENi7 in the
DTCENi register during operation when the setting of data transfer (the first transfer in chain transfers) is either
of the following:
Transfer causing the DTCCTj (j = 0 to 23) register value to change to 0 in normal mode
Transfer causing the DTCCTj register value to change to 0 while the RPTINT bit in the DTCCRj register is 1
(interrupt generation enabled) in repeat mode
If the data transfer setting is not either of the above, the DTC sets 0 to the interrupt source flag corresponding to
the activation source during operation.
If multiple activation sources are simultaneously generated, the DTC activation will be performed according to
the DTC activation source priority.
If multiple activation sources are simultaneously generated on completion of DTC operation, the next transfer
will be performed according to the priority.
DTC activation is not affected by the I flag or interrupt control register, unlike with interrupt request operation.
Therefore, even if interrupt requests cannot be acknowledged because interrupts are disabled, DTC activation
requests can be acknowledged. The IR bit in the interrupt control register does not change even when an
interrupt source to enable DTC activation is generated.
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| R5F2136CSNFA#V0 | 制造商:Renesas Electronics Corporation 功能描述:R8C36TA 128+4K/10K 64LQFP - Trays 制造商:Renesas Electronics Corporation 功能描述:IC MCU 16BIT 128KB FLASH 64LQFP |
| R5F2136CSNFP | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:RENESAS MCU |
| R5F2136CSNFP#V0 | 制造商:Renesas Electronics Corporation 功能描述:R8C36TA 128+4K/10K 64LQFP - Trays 制造商:Renesas Electronics Corporation 功能描述:IC MCU 16BIT 128KB FLASH 64LQFP |
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