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參數(shù)資料
| 型號： | R5F212ACSNFA |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, FLASH, 20 MHz, RISC MICROCONTROLLER, PQFP48 |
| 封裝： | 14 X 14 MM, 0.80 MM PITCH, PLASTIC, LQFP-48 |
| 文件頁數(shù)： | 30/138頁 |
| 文件大小： | 492K |
| 代理商： | R5F212ACSNFA |
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212
4317K–AVR–03/2013
AT90PWM2/3/2B/3B
19. EUSART (Extended USART)
The Extended Universal Synchronous and Asynchronous serial Receiver and Transmitter
(EUSART) provides functionnal extensions to the USART.
19.1
Features
Independant bit number configuration for transmit and receive
Supports Serial Frames with 5, 6, 7, 8, 9 or 13, 14, 15, 16, 17 Data Bits and 1 or 2 Stop Bits
Biphase Manchester encoder/decoder (for DALI Communications)
Manchester framing error detection
Bit ordering (MSB first or LSB first)
19.2
Overview
A simplified block diagram of the EUSART Transmitter is shown in Figure 19-1. CPU accessible
I/O Registers and I/O pins are shown in bold.
Figure 19-1. EUSART Block Diagram
The EUSART is activated with the EUSART bit of EUCSRB register. Until this bit is not set, the
USART will behave as standard USART, all the functionnalities of the EUSART are not
accessible.
PARITY
GENERATOR
UBRR[H:L]
UDR
(Transmit)
EUDR
(Transmit)
UDR
(Receive)
EUDR
(Receive)
UCSRA
UCSRB
UCSRC
EUCSRA
EUCSRB
EUCSRC
BAUD RATE GENERATOR
TRANSMIT SHIFT REGISTER
RECEIVE SHIFT REGISTER
RxD
TxD
PIN
CONTROL
PIN
CONTROL
XCK
DATA
RECOVERY
CLOCK
RECOVERY
PIN
CONTROL
TX
CONTROL
RX
CONTROL
PARITY
CHECKER
MANCHESTER
ENCODER
DATA
BUS
CLKio
SYNC LOGIC
Clock Generator
Transmitter
Receiver
MANCHESTER
DECODER
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| R5F212BASDFP | 16-BIT, FLASH, 20 MHz, RISC MICROCONTROLLER, PQFP48 |
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| R5F212ACSDFP | 16-BIT, FLASH, 20 MHz, RISC MICROCONTROLLER, PQFP48 |
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參數(shù)描述 |
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