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參數(shù)資料
| 型號： | Q67003H9339 |
| 廠商： | SIEMENS AG |
| 英文描述： | ICs for Communications |
| 中文描述： | 通信集成電路 |
| 文件頁數(shù)： | 117/397頁 |
| 文件大?。?/td> | 1987K |
| 代理商： | Q67003H9339 |
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PEB 22554
Operational Description E1
Semiconductor Group
117
09.98
changing the transmit time-slot assignment) by the transmit system
highway unless register XC1 is written. Useful in loop-timed
applications. For proper operation the transmit elastic buffer (2
frames, SIC1.XBS1/0= 10) has to be enabled.
XRA…
Transmit Remote Alarm
0…
Normal operation.
1…
Sends remote alarm towards remote end by setting bit 3 of the
service word. If time-slot 0 transparent mode is enabled via bit
XSP.TT0 or TSWM.TRA bit is set, bit XSW.XRA will be ignored.
XY0…XY4…
Spare Bits For National Use (Y-Bits, S
n
-Bits, S
a
-Bits)
These bits are inserted in the service word of every other pulseframe
if S
a
-bit register access is disabled (FMR1.ENSA = 0). If not used,
they should be fixed to ‘1’.
If one of the time-slot 0 transparent modes is enabled (bit XSP.TT0 or
TSWM.TSA4-8), bits XSW.XY0…4 will be ignored.
Transmit Spare Bits (Read/Write)
Value after RESET: 00
H
CASEN…
Channel Associated Signaling Enable
0…
Normal operation.
1…
A one in this bit position will cause the transmitter to send the
CAS information stored in the XS1-16 registers in the
corresponding time slots.
TT0…
Time-Slot 0 Transparent Mode
0…
Normal operation.
1…
All information for time-slot 0 at port XDI will be inserted in the
outgoing pulseframe. All internal information of the QuadFALC
(framing, CRC, S
a
/S
i
bit signaling, remote alarm) will be
ignored. This function is mainly useful for system test
applications (test loops). Priority sequence of transparent
modes: XSP.TTO > TSWM.
7
0
XSP
CASEN
TT0
EBP
AXS
XSIF
XS13
XS15
(x21)
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