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參數(shù)資料
| 型號(hào)： | PSD713S5 |
| 英文描述： | Field Programmable Microcontroller Peripherals with Supervisory Functions(可編程邏輯，4K位SRAM,27個(gè)可編程I/O,通用PLD有66個(gè)輸入) |
| 中文描述： | 現(xiàn)場(chǎng)可編程微控制器外圍設(shè)備具有監(jiān)督職能（可編程邏輯，4K的位的SRAM，27余個(gè)可編程輸入/輸出，通用PLD的有66個(gè)輸入） |
| 文件頁(yè)數(shù)： | 3/104頁(yè) |
| 文件大?。?/td> | 515K |
| 代理商： | PSD713S5 |
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PSD7XX Family
13-3
PAGE REG
PMU
INCLUDING
CMISER
FEATURES
VSTDBY
I/O PORT
PROGRAMMABLE
I/O PORT
PROGRAMMABLE
I/O PORT
PROGRAMMABLE
I/O PORT
PROGRAMMABLE
MCU
ADDRESS/DATA
AD0-AD15
MCU
CONTROL
INTERFACE
CONTROL
RD, WR
SECURITY
FEATURE
CLKIN
46
24
66
66
GRESET OR ERESET
P
P
OUTPUT MICRO
CELL FEEDBACK
INPUT MICRO
CELL & INPUT PORTS
DIRECT MICRO
CELL OUTPUT TO DATA BUS
EPROM
SRAM
256K –1 MBIT EPROM
4K BITS BATTERY
BACK- UP
BATTERY BACK-UP
I/O DECODE
EXTERNAL CS PLD
DECODE PLD
MCU ADDRESS / 8 OR 16-BIT DATA/CONTROL BUS
7 EXTERNAL
CHIP SELECTS
PERIPHERAL SELECTS
GENERAL PLD
PERIPHERAL
PLD
CHIP SELECT
TO
I/O ALLOCATOR
PT
ALLOC.
MICRO
CELL
ALLOCATOR
DIRECT MICRO
CELLS
ACCESS FROM DATA BUS
104
PT
2
PT
6 NIBBLE
PT
I
PA0–PA7
PB0–PB7
PD0–PD2
PC0–PC1
PC3–PC7
12 OUTPUT
MICRO
CELLS
WATCHDOG
TIMER
POWER
MONITOR
RESET PULSE
GENERATOR
24 INPUT
MICRO
CELLS (PORT A,B,C)
(PC2)
RESET
Vtp
RST–OUT
CE OUT
VSTBY ON
WDOG–ON
SUPERV–CLK
PSD7XX Architectural Overview
(cont.)
Figure 1. PSD7XX Block Diagram
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