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參數(shù)資料
| 型號： | PSD601E1 |
| 英文描述： | Field Programmable Microcontroller Peripherals with Embedded Micro--Cell(可編程邏輯，4K位SRAM,26個可編程I/O,通用PLD有63個輸入) |
| 中文描述： | 現(xiàn)場可編程微控制器外圍設(shè)備和嵌入式微-細(xì)胞（可編程邏輯，4K的位的SRAM，26我個可編程輸入/輸出，通用PLD的有63個輸入） |
| 文件頁數(shù)： | 69/84頁 |
| 文件大?。?/td> | 426K |
| 代理商： | PSD601E1 |
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PSD6XX Family
11-69
-70
-90
-15
CMiser
ON
Symbol
Parameter
Conditions
Min
Max
Min
Max
Min
Max
Unit
t
LVLX
t
AVLX
t
LXAX
t
AVQV
t
SLQV
ALE or AS Pulse Width
18
20
28
0
ns
Address Setup Time
(Note 4)
5
6
10
0
ns
Address Hold Time
(Note 4)
7
8
11
0
ns
Address Valid to Data Valid
(Note 4)
70
90
150
Add 10
ns
CS Valid to Data Valid
80
100
150
Add 10
ns
RD to Data Valid
8/16-Bit Bus
(Note 3)
20
32
40
0
ns
t
RLQV
RD to Data Valid 8-Bit Bus,
8031, 80251 Separate Mode
(Note 3a)
32
38
45
0
ns
t
RHQX
t
RLRH
t
RHQZ
t
EHEL
t
THEH
t
ELTL
RD Data Hold Time
(Note 3)
0
0
0
0
ns
RD Pulse Width
(Note 3)
30
32
38
0
ns
RD to Data High-Z
(Note 3)
22
25
33
0
ns
E Pulse Width
30
32
38
0
ns
R/W Setup Time to Enable
8
10
18
0
ns
R/W Hold Time After Enable
0
0
0
0
ns
In 16-Bit Bus Mode
(Note 5)
20
30
38
0
ns
t
AVPV
Address Input Valid to
Address Output Delay
In 8-Bit Bus Mode
(Note 5)
22
32
48
0
ns
Read Timing
Microcontroller Interface – AC/DC Parameters
NOTES:
3.
RD timing has the same timing as DS, LDS, UDS, PSEN (in 8031 combined mode) signals.
3a. RD and PSEN have the same timing for 8031 separate mode.
4.
Any input used to select an internal PSD6XXE1 function.
5.
In multiplexed mode latched address generated from ADIO delay to address output on any Port.
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PDF描述 |
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| PSD602E1-70L | 制造商:WSI 功能描述: |
| PSD603E1-70L | 制造商:WSI 功能描述: |
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