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參數(shù)資料
| 型號： | PM7366-BI |
| 廠商： | PMC-SIERRA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | TVS BI-DIR 30V 1500W DO-201 |
| 中文描述： | 8 CHANNEL(S), 64K bps, SERIAL COMM CONTROLLER, PBGA256 |
| 封裝： | 27 X 27 MM, 1.45 MM HEIGHT, SBGA-256 |
| 文件頁數(shù)： | 148/286頁 |
| 文件大?。?/td> | 2243K |
| 代理商： | PM7366-BI |
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RELEASED
DATA SHEET
PM7366 FREEDM-8
ISSUE 4
PMC-1970930
FRAME ENGINE AND DATA LINK MANAGER
PROPRIETARY AND CONFIDENTIAL TO PMC-SIERRA,INC., AND FOR ITS CUSTOMERS’ INTERNAL USE
135
CHAN[6:0]:
The indirect data bits (CHAN[6:0]) report the channel number read from the RMAC internal
memory after an indirect read operation has completed. Channel number to be written to the
RMAC internal memory in an indirect write operation must be set up in this register before
triggering the write. CHAN[6:0] reflects the value written until the completion of a subsequent
indirect read operation.
PROV:
The indirect provision enable bit (PROV) reports the channel provision enable flag read from
the RMAC internal memory after an indirect read operation has completed. The provision
enable flag to be written to the RMAC internal memory, in an indirect write operation, must be
set up in this register before triggering the write. When PROV is set high, the channel as
indicated by CHAN[6:0] is provisioned. When PROV is set low, the channel indicated by
CHAN[6:0] is unprovisioned temporarily. Any partially received packets are flushed and the
status in the RPDRR queue is marked unprovisioned. The channel then returns to being
provisioned and PROV will report a logic high at the next indirect read operation. PROV
reflects the value written until the completion of a subsequent indirect read operation.
RWB:
The Read/Write Bar (RWB) bit selects between a provisioning/unprovisioning operation (write)
or a query operation (read). Writing a logic 0 to RWB triggers the provisioning or
unprovisioning of a channel as specified by CHAN[6:0] and PROV. Writing a logic 1 to RWB
triggers a query of the channel specified by CHAN[6:0].
BUSY:
The indirect access status bit (BUSY) reports the progress of an indirect access. BUSY is set
high when this register is written to trigger an indirect access, and will stay high until the
access is complete. At which point, BUSY will be set low. This register should be polled to
determine when data from an indirect read operation is available or to determine when a new
indirect write operation may commence.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM7366-PI | FRAME ENGINE AND DATA LINK MANAGER |
| PM7367-PI | DIODE 1N4002 RECTIFYING |
| PM7367 | 32 link, 32 Channel Data Link Manager with PCI Interface |
| PM7375 | ATM SAR and PHY Processor for PCI Bus |
| PM7375-SC | LOCAL ATM SAR & PHYSICAL LAYER |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PM7366-PI | 制造商:PMC-Sierra 功能描述: |
| PM7367 | 制造商:PMC 制造商全稱:PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER |
| PM7367-PI | 制造商:PMC 制造商全稱:PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER |
| PM-737 | 制造商:Eclipse Tools 功能描述: |
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