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參數(shù)資料
| 型號(hào)： | PM7366-BI |
| 廠商： | PMC-SIERRA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | TVS BI-DIR 30V 1500W DO-201 |
| 中文描述： | 8 CHANNEL(S), 64K bps, SERIAL COMM CONTROLLER, PBGA256 |
| 封裝： | 27 X 27 MM, 1.45 MM HEIGHT, SBGA-256 |
| 文件頁(yè)數(shù)： | 123/286頁(yè) |
| 文件大?。?/td> | 2243K |
| 代理商： | PM7366-BI |
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RELEASED
DATA SHEET
PM7366 FREEDM-8
ISSUE 4
PMC-1970930
FRAME ENGINE AND DATA LINK MANAGER
PROPRIETARY AND CONFIDENTIAL TO PMC-SIERRA,INC., AND FOR ITS CUSTOMERS’ INTERNAL USE
110
non-data bytes. The choice between treating all data bits as a contiguous stream with
arbitrary byte alignment or byte aligned to gaps in RCLK[0] is controlled by the BSYNC bit.
E1:
The E1 frame structure select bit (E1) configures receive link #0 for channelised E1 operation
when CEN is set high. RCLK[0] is held quiescent during the FAS and NFAS framing bytes.
The data bit on RD[0] associated with the first rising edge of RCLK[0] after an extended
quiescent period is considered to be the most significant bit of time-slot 1. Link data is
present at time-slots 1 to 31. When E1 is set low and CEN is set high, receive link #0 is
configured for channelised T1 operation. RCLK[0] is held quiescent during the framing bit.
The data bit on RD[0] associated with the first rising edge of RCLK[0] after an extended
quiescent period is considered to be the most significant bit of time-slot 1. Link data is
present at time-slots 1 to 24. E1 is ignored when CEN is set low.
BSYNC:
The byte synchronisation enable bit (BSYNC) controls the interpretation of gaps in RCLK[0]
when link #0 is in unchannelised mode (CEN set low). When BSYNC is set high, the data bit
on RD[0] clocked in by the first rising edge of RCLK[0] after an extended quiescent period is
considered to be the most significant bit of a data byte. When BSYNC is set low, gaps in
RCLK[0] carry no special significance. BSYNC is ignore when CEN is set high.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PM7366-PI | FRAME ENGINE AND DATA LINK MANAGER |
| PM7367-PI | DIODE 1N4002 RECTIFYING |
| PM7367 | 32 link, 32 Channel Data Link Manager with PCI Interface |
| PM7375 | ATM SAR and PHY Processor for PCI Bus |
| PM7375-SC | LOCAL ATM SAR & PHYSICAL LAYER |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PM7366-PI | 制造商:PMC-Sierra 功能描述: |
| PM7367 | 制造商:PMC 制造商全稱:PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER |
| PM7367-PI | 制造商:PMC 制造商全稱:PMC 功能描述:FRAME ENGINE AND DATA LINK MANAGER |
| PM-737 | 制造商:Eclipse Tools 功能描述: |
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