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參數(shù)資料
| 型號： | PEF82913H |
| 英文描述： | 40MHz Video Fader and DC Gain Controlled Amplifier; Package: PDIP; No of Pins: 14; Temperature Range: 0°C to +70°C |
| 中文描述： | ？2B1Q第二代模塊化綜合業(yè)務(wù)數(shù)字網(wǎng)新臺幣（智能）？ |
| 文件頁數(shù)： | 40/205頁 |
| 文件大?。?/td> | 3205K |
| 代理商： | PEF82913H |
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PEF 82902
Functional Description
Data Sheet
28
2001-11-09
The frame is composed of three channels:
Channel 0 contains 144-kbit/s of user and signaling data (2B + D), a MONITOR
programming channel (MON0) and a command/indication channel (CI0) for control
and programming of e.g. the U-transceiver.
Channel 1 contains two 64-kbit/s intercommunication channels (IC), a MONITOR
programming channel (MON1) and a command/indication channel (CI1) for control
and programming of e.g. the S-transceiver.
Channel 2 is used for D-channel access mechanism (TlC-bus, S/G bit). Additionally,
channel 2 supports further IC and MON channels.
2.3.2
IOM -2 Handler
The IOM -2 handler offers a great flexibility for handling the data transfer between the
different functional units of the T-SMINT I and voice/data devices connected to the
IOM -2 interface. Additionally it provides a microcontroller access to all time slots of the
IOM -2 interface via the four controller data access registers (CDA).
The PCM data of the functional units
S-transceiver (S) and the
Controller data access (CDA)
can be configured by programming the time slot and data port selection registers
(TSDP). With the TSS bits (Time Slot Selection) the PCM data of the functional units can
be assigned to each of the 12 PCM time slots of the IOM -2 frame. With the DPS bit
(Data Port Selection) the output of each functional unit is assigned to DU or DD
respectively. The input is assigned vice versa. With the control registers (CR) the access
to the data of the functional units can be controlled by setting the corresponding control
bits (EN, SWAP).
The IOM -2 handler also provides access to the
U and S transceiver
MONITOR channel
C/I channels (CI0,CI1)
TIC bus (TIC)
The access to these channels is controlled by the registers S_CR, CI_CR and MON_CR.
The IOM -2 interface with the two Serial Data Strobes (SDS1,2) is controlled by the
control registers IOM_CR, SDS1_CR and SDS2_CR.
The following
Figure 11
shows the architecture of the IOM -2 handler.
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