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參數(shù)資料
| 型號(hào)： | PCM1792A |
| 英文描述： | 24-bit,192-khz sampling,advanced segment, audio stereo digital-to-analog converter |
| 中文描述： | 24位,192 - kHz的采樣，先進(jìn)的部分，立體聲音頻數(shù)字模擬轉(zhuǎn)換器 |
| 文件頁(yè)數(shù)： | 21/59頁(yè) |
| 文件大?。?/td> | 500K |
| 代理商： | PCM1792A |
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SLES105B FEBRUARY 2004 REVISED NOVEMBER 2006
www.ti.com
21
MSB
LSB
Register Index (or Address)
Register Data
R/W
IDX6
IDX5
IDX4
IDX3
IDX2
IDX1
IDX0
D7
D6
D4
D5
D3
D2
D1
D0
Figure 29. Control Data Word Format for MDI
High Impedance
When Read Mode is Instructed
A0
D7
D6
D4
D5
D3
D2
D1
D0
D7
D6
D4
D5
D3
D2
D1
D0
R/W
A1
A2
A3
A4
A5
A6
MS
MC
MDI
MDO
NOTE: Bit 15 is used for selection of write or read. Setting R/W = 0 indicates a write, while R/W = 1 indicates a read. Bits 148 are used for the register
address. Bits 7–0 are used for register data.
Figure 30. Serial Control Format
t(MCH)
50% of VDD
MS
t(MSS)
LSB
50% of VDD
50% of VDD
t(MCL)
t(MHH)
t(MSH)
t(MCY)
t(MDH)
t(MDS)
MC
MDI
t(MOS)
50% of VDD
MDO
PARAMETER
MIN
100
MAX
UNITS
ns
t(MCY)
t(MCL)
t(MCH)
t(MHH)
t(MSS)
t(MSH)
t(MDH)
t(MDS)
t(MOS)
(1)MC rising edge for LSB to MS rising edge
Figure 31. Control Interface Timing
MC pulse cycle time
MC low-level time
40
ns
MC high-level time
40
ns
MS high-level time
80
ns
MS falling edge to MC rising edge
MS hold time(1)
15
ns
15
ns
MDI hold time
15
ns
MDI setup time
15
ns
MC falling edge to MDO stable
30
ns
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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| PCM1792ADBR | 功能描述:音頻數(shù)/模轉(zhuǎn)換器 IC 24-Bit 192kHz Smplng AdvSegment Ster DAC RoHS:否 制造商:Texas Instruments 轉(zhuǎn)換器數(shù)量: 分辨率:16 bit 接口類型:I2S, UBS 轉(zhuǎn)換速率: 信噪比:98 dB 工作電源電壓:5 V DAC 輸出端數(shù)量:2 工作溫度范圍:- 25 C to + 85 C 電源電流:23 mA 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:TQFP-32 封裝:Reel |
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