參數(shù)資料
型號(hào)： MTC20154
廠商： 意法半導(dǎo)體
英文描述： INTEGRATED ADSL CMOS ANALOG FRONT-END CIRCUIT
中文描述： 集成ADSL CMOS模擬前端電路
文件頁(yè)數(shù)： 13/21頁(yè)
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代理商： MTC20154
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MTC20154
Table 12. Linearity of ATU-R-RX
Table 13. Linearity of ATU-C-RX
A/D Converter
A pipeline architecture is used for the A/D converter.
Table 14. A/D Converter specifications
Power Supply Rejection
The noise on the power supplies for the RX-path must be lower than the following: < 50 mVrms in-band
white noise for any AVDD.
Figure 7. Power Supply Rejection
f1 (0.5 Vpd)
f2 (0.5 Vpd)
S/IM3
(AGC = 0 dB)
300 kHz
200 kHz
59.5 dB @100 kHz
53.5 dB @400 kHz
43.5 dB @700 kHz
42.5 dB @800 kHz
500 kHz
400 kHz
59.5 dB @300 kHz
48.0 dB @600 kHz
700 kHz
600 kHz
48.0 dB @500 kHz
42.5 dB @800 kHz
f1 (0,5 Vpd)
f2 (0,5 Vpd)
S/IM3
(AGC = 20 dB)
80 kHz
70 kHz
56.5 dB @60 kHz
56.5 dB @90 kHz
Number of bits:
Minimum resolution of the A/D converter
Linearity error of the A/D converter (range: -6 dB FS)
Full scale input range:
Sampling rate:
Maximum attenuation at 1.1 MHz:
Latency:
13 bits
11 bits
< 4 LSB (out of 13 bits)
1.1 Vpdif (+- 5 % @ 3.3 V)
8.832 MHz
< 0.5 dB without in-band ripple
5 sampling clock periods
1k
-40
dB
Hz
-50
-60
-70
10k 100k 1M 10M
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