參數(shù)資料
型號： MSP430P315S
廠商： Texas Instruments, Inc.
英文描述： MIXED SIGNAL MICROCONTROLLERS
中文描述： 混合信號微處理器
文件頁數(shù)： 55/70頁
文件大?。?/td> 1176K
代理商： MSP430P315S
SLAS368D
OCTOBER 2002
REVISED MARCH 2005
55
POST OFFICE BOX 655303
DALLAS, TEXAS 75265
APPLICATION INFORMATION
input/output schematic (continued)
port P3, P3.2, input/output with Schmitt-trigger
P3.2/SOMI0
P3IN.2
Pad Logic
EN
D
P3OUT.2
SO(MI)0
P3DIR.2
P3SEL.2
0
1
0
1
DCM_SOMI
SYNC
MM
STE
STC
From USART0
(SO)MI0
To USART0
0: Input
1: Output
port P3, P3.3, input/output with Schmitt-trigger
P3.3/UCLK0/SCL
P3IN.3
Pad Logic
EN
D
P3OUT.3
UCLK.0
P3DIR.3
P3SEL.3
0
1
0
1
DCM_UCLK
SYNC
MM
STE
STC
From USART0
UCLK0
To USART0
0: Input
1: Output
NOTE: UART mode:
The UART clock can only be an input. If UART mode and UART function are selected, the P3.3/UCLK0 is always
an input.
The clock applied to UCLK0 is used to shift data in and out.
The clock to shift data in and out is supplied to connected devices on pin P3.3/UCLK0 (in slave mode).
The clock applied to SCL is used to shift data in and out. The frequency of the clock source of the module must be
10 times the frequency of the SCL clock.
To shift data in and out, the clock is supplied via the SCL terminal to all I
2
C slaves. The frequency of the clock source
of the module must be
10 times the frequency of the SCL clock.
SPI, slave mode:
SPI, master mode:
I
2
C, slave mode:
I
2
C, master mode:
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