參數(shù)資料
型號(hào)： MQ80C32E-30/883
廠商： TEMIC SEMICONDUCTORS
元件分類： 微控制器/微處理器
英文描述： 8-BIT, 30 MHz, MICROCONTROLLER, CQFP44
文件頁(yè)數(shù)： 132/198頁(yè)
文件大?。?/td> 4822K
代理商： MQ80C32E-30/883
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39
8111C–MCU Wireless–09/09
AT86RF231
Figure 7-2.
Timing of RX_START, AMI and TRX_END Interrupts in Basic Operating Mode
7.1.4
Basic Operating Mode Timing
The following paragraphs depict state transitions and their timing properties. Timing figures are
7.1.4.1
Power-on Procedure
The power-on procedure to P_ON state is shown in Figure 7-3 on page 39.
Figure 7-3.
Power-on Procedure to P_ON State
When the external supply voltage (V
DD) is firstly supplied to the AT86RF231, the radio trans-
ceiver enables the crystal oscillator (XOSC) and the internal 1.8 V voltage regulator for the
digital domain (DVREG). After t
TR1 = 330 s (typ.), the master clock signal is available at pin 17
(CLKM) at default rate of 1 MHz. If CLKM is available the SPI is already enabled and can be
used to control the transceiver. As long as no state change towards state TRX_OFF is per-
formed the radio transceiver remains in P_ON state.
128
160
192
0
192+(9+m)*32
-16
Time [s]
RX
(Dev
ic
e2)
IRQ_2 (RX_START)
RX_ON
IRQ
TRX_STATE
Interrupt latency
TRX_END
IRQ_5 (AMI)
tIRQ
BUSY_RX
IRQ_3 (TRX_END)
TX
(D
ev
ic
e1
)
PLL_ON
BUSY_TX
PLL_ON
IRQ
SLP_TR
TRX_STATE
Typ. Processing Delay
16 s
Fr
am
e
on
Ai
r
Preamble
SFD
PHR
MSDU
41
1
m
Number of Octets
Frame Content
MHR
7
FCS
2
tIRQ
0
Event
State
VDD on
P_ON
Block
XOSC, DVREG
100
CLKM on
400
Time [s]
Time
tTR1
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PDF描述
MR80C52CXXX-16/883R 8-BIT, MROM, 16 MHz, MICROCONTROLLER, CQCC44
MR80C52TXXX-16SB 8-BIT, MROM, 16 MHz, MICROCONTROLLER, CQCC44
MD83C154TXXX-L16P883D 8-BIT, MROM, 16 MHz, MICROCONTROLLER, CDIP40
MD83C154XXX-L16P883D 8-BIT, MROM, 16 MHz, MICROCONTROLLER, CDIP40
MQ80C32E-16SB 8-BIT, 16 MHz, MICROCONTROLLER, CQFP44
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