參數(shù)資料
型號(hào)： MPC562MZP66R2
廠商： Freescale Semiconductor
文件頁數(shù)： 441/1420頁
文件大?。?/td> 0K
描述： IC MPU 32BIT 66MHZ 388-PBGA
標(biāo)準(zhǔn)包裝： 500
系列： MPC5xx
核心處理器： PowerPC
芯體尺寸： 32-位
速度： 66MHz
連通性： CAN，EBI/EMI，SCI，SPI，UART/USART
外圍設(shè)備： POR，PWM，WDT
輸入/輸出數(shù)： 64
程序存儲(chǔ)器類型： ROMless
RAM 容量： 32K x 8
電壓 - 電源 (Vcc/Vdd)： 2.5 V ~ 2.7 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 32x10b
振蕩器型： 外部
工作溫度： -40°C ~ 125°C
封裝/外殼： 388-BBGA
包裝： 帶卷 (TR)
配用： MPC564EVB-ND - KIT EVAL FOR MPC561/562/563/564
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MPC561/MPC563 Reference Manual, Rev. 1.2
Freescale Semiconductor
RegIndex-3
floating-point exception cause register (FPECR)
floating-point registers (FPRs)
floating-point status and control register (FPSCR)
general special-purpose registers (SPRG0-SPRG3)
general-purpose registers (GPRs)
implementation-specific
special-purpose
registers
integer exception register (XER)
link register (LR)
machine state register (MSR)
machine status save/restore register 0 (SRR0)
machine status save/restore register 1 (SRR1)
OEA register set
processor version register (PVR)
UISA register set
VEA register set - time base
READI development control register
READI device ID register
READI DID
READI DTA 1 and DTA 2 (READI data trace attributes 1
and 2 registers)
READI RWA (READI read/write access register)
READI UBA (READI user base accress register)
READI UDI (READI upload/download information regis-
ter)
Region attribute register (0 - 3)
Register diagrams
CALRLAM_OTR (CALRAM ownership trace regis-
ter)
CANCTRL0 (control register 0)
CANCTRL1 (control register 1)
CANCTRL2 (control register 2)
CFSR0 (TPU3 channel function select register 0)
CFSR1 (TPU3 channel function select register 1)
CFSR2 (TPU3 channel function select register 2)
CFSR3 (TPU3 channel function select register 3)
CIER (TPU3 channel interrupt enable register)
CISR (TPU3 channel interrupt status register)
CMPG-CMPH (comparator G-H value registers)
COUNTA (breakpoint counter A value and control
register)
CPR0 (TPU3 channel priority register 0)
CPR1 (TPU3 channel priority register 1)
CRAM_RBAx (CALRAM region base address regis-
ter)
CRAMMCR (CALRAM module configuration regis-
ter)
CRAMOVL (CALRAM overlay configuration regis-
ter)
DDRQA (QADC64E port A data direction registers)
DDRQS (PORTQS data direction register)
DER (debug enable register)
DSCR (TPU3 development support control register)
DSSR (TPU3 development support status register)
ECR (exception cause register)
EIBADR (external interrupt relocation table base ad-
dress register)
HSQR0 (TPU3 host sequence register 0)
HSQR1 (TPU3 host sequence register 1)
HSSR0 (TPU3 host service request register 0)
HSSR1 (TPU3 host service request register 1)
IMASK (interrupt mask register)
L2U_GRA (L2U global region attribute register)
L2U_MCR (L2U module configuration register)
L2U_RAx (L2U region X attribute register)
L2U_RBAx (L2U region x base address register)
LCTRL2 (L-bus support control register 2)
MIOS14SR0 (interrupt status register)
MIOS14SR1 (interrupt status register)
MIOS1LVL0 (MIOS1 interrupt level register 0)
MIOS1LVL1 (MIOS1 interrupt level 1 register)
MISCNT (MISC counter)
MISRH (multiple input signature register high)
MISRL (multiple input signature register low)
PORTQS (port QS data register)
PQSPAR (PORTQS pin assignment register)
PRESDIV (prescaler divide register)
QACR1 (QADC64E control register 1)
QADCMCR (module configuration register)
QSCI1CR (QSCI1 control register)
QSCI1SR (QSCI1 status register)
QSMCMMCR (QSMCM module configuration regis-
ter)
QSPI_IL (QSPI interrupt level register)
READI DTA 1 and DTA 2 (READI data trace at-
tributes 1 and 2 registers)
Region attribute register (0 - 3)
SCCxR0 (QSMCM SCI control register 0)
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