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ML671000 User’s Manual
Chapter 10 Direct Memory Access Controller (DMAC)
10-18
10.3.
Operational Description
The DMAC starts a DMA transfer when it receives a transfer request and stops the transfer after the
specified count.
A successful DMA transfer requires specifying the data transfer source, the data transfer destination, and
the combination of transfer request and transfer format matching the data transfer method and format.
10.3.1. Transfer Requests
Transfer requests are the starting triggers for DMA transfers.
These triggers have three main sources: external devices, on-chip peripherals, and software. The DMA
transfer request select registers (DTRSx, x=0 to 1) specify the source for the corresponding channel.
1. Transfer requests from external devices
The 00111B selection specifies transfer requests from external devices via the nDREQx pin. The DRQDx
bit in the corresponding DMA channel mode register (DCMx) specifies the sensing for the channel: “L”
level input or falling edge. The controller responds to the nDREQx signal by sending the corresponding
DACKx signal.
Figure 10-16 shows the timing for sampling nDREQx pin input.
Sampling is at the rising edges of the system clock (SYSCLK) signal. The DRQD bit in the corresponding
DMA channel mode register (DCMx) specifies the sensing for the channel: falling edge or "L" level input.
Because of this sampling timing, the width of the "H" and "L" level pulses in the nDREQ pin input must be
at least two system clock (SYSCLK) periods.
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