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參數(shù)資料
| 型號： | MD80C52EXXX-20SB |
| 廠商： | ATMEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 20 MHz, MICROCONTROLLER, CDIP40 |
| 封裝： | 0.600 INCH, CERAMIC, DIP-40 |
| 文件頁數(shù)： | 112/198頁 |
| 文件大?。?/td> | 4822K |
| 代理商： | MD80C52EXXX-20SB |
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20
8111C–MCU Wireless–09/09
AT86RF231
Figure 6-5.
Packet Structure - Register Write Access
Each register access must be terminated by setting /SEL = H.
Figure 6-6 on page 20 illustrates a typical SPI sequence for a register access sequence for write
and read respectively.
Figure 6-6.
Example SPI Sequence - Register Access Mode
6.2.2
Frame Buffer Access Mode
The 128-byte Frame Buffer can hold the PHY service data unit (PSDU) data of one
IEEE 802.15.4 compliant RX or one TX frame of maximum length at a time. A detailed descrip-
tion of the Frame Buffer can be found in Section 9.3 “Frame Buffer” on page 107. An introduction
to the IEEE 802.15.4 frame format can be found in Section 8.1 “Introduction - IEEE 802.15.4 -
Frame Buffer read and write accesses are used to read or write frame data (PSDU and addi-
tional information) from or to the Frame Buffer. Each access starts with /SEL = L followed by a
command byte on MOSI. If this byte indicates a frame read or write access, the next byte
PHR[7:0] indicates the frame length followed by the PSDU data, see Figure 6-7 on page 20 and
On Frame Buffer read access, PHY header (PHR) and PSDU are transferred via MISO starting
with the second byte. After the PSDU data, one more byte is transferred containing the link qual-
ity indication (LQI) value of the received frame, for details refer to Section 8.6 “Link Quality
Indication (LQI)” on page 99. Figure 6-7 on page 20 illustrates the packet structure of a Frame
Buffer read access.
Figure 6-7.
Packet Structure - Frame Read Access
1
ADDRESS[5:0]
1
WRITE DATA[7:0]
MOSI
PHY_STATUS
XX
MISO
byte 1 (command byte)
byte 2 (data byte)
PHY_STATUS
XX
PHY_STATUS
READ DATA
WRITE COMMAND
WRITE DATA
READ COMMAND
XX
Register Write Access
Register Read Access
SCLK
MOSI
MISO
/SEL
0
reserved[4:0]
0
MOSI
PHY_STATUS
MISO
byte 1 (command byte)
1
XX
PHR[7:0]
byte 2 (data byte)
XX
PSDU[7:0]
byte 3 (data byte)
XX
PSDU[7:0]
byte n-1 (data byte)
XX
LQI[7:0]
byte n (data byte)
相關PDF資料 |
PDF描述 |
|---|---|
| MQ80C32E-36SC | 8-BIT, 36 MHz, MICROCONTROLLER, CQFP44 |
| MR80C52XXX-20:R | 8-BIT, MROM, 20 MHz, MICROCONTROLLER, CQCC44 |
| MQ80C32E-30/883 | 8-BIT, 30 MHz, MICROCONTROLLER, CQFP44 |
| MR80C52CXXX-16/883R | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, CQCC44 |
| MR80C52TXXX-16SB | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, CQCC44 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| MD80C86 | 制造商:INTERSIL 制造商全稱:Intersil Corporation 功能描述:CMOS 16-Bit Microprocessor |
| MD80C862 | 制造商:Intel 功能描述:PROCESSOR:MICRO-PROCESSOR |
| MD80C86-2 | 制造商:INTERSIL 制造商全稱:Intersil Corporation 功能描述:CMOS 16-Bit Microprocessor |
| MD80C86-2/883 | 制造商:Intersil Corporation 功能描述:MPU 16BIT CMOS 8MHZ 40CDIP - Rail/Tube 制造商:Rochester Electronics LLC 功能描述:CPU 16BILT 5V CMOS 8MHZ 40CDIP - Bulk |
| MD80C86-2/B | 制造商:Intersil Corporation 功能描述:MPU 16BIT CMOS 8MHZ 40CDIP - Rail/Tube |
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