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參數(shù)資料
| 型號： | MCIMX357CJM5B |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 140/147頁 |
| 文件大?。?/td> | 0K |
| 描述： | MPU MX35 ARM11 400-MAPBGA |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 系列： | i.MX35 |
| 核心處理器： | ARM11 |
| 芯體尺寸： | 32-位 |
| 速度： | 532MHz |
| 連通性： | 1 線，CAN，EBI/EMI，以太網(wǎng)，I²C，MMC，SPI，SSI，UART/USART，USB OTG |
| 外圍設(shè)備： | DMA，I²S，LCD，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 96 |
| 程序存儲器類型： | ROMless |
| RAM 容量： | 128K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.33 V ~ 1.47 V |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 400-LFBGA |
| 包裝： | 托盤 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁當(dāng)前第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁
i.MX35 Applications Processors for Industrial and Consumer Products, Rev. 10
Freescale Semiconductor
92
IP55 Controls hold time for read
Tdchr
Tdicpr – Tdicdr – 1.5
Tdicpr – Tdicdr
—
ns
IP56 Controls setup time for write
Tdcsw
Tdicuw – 1.5
Tdicuw
—
ns
IP57 Controls hold time for write
Tdchw
Tdicpw – Tdicdw – 1.5
Tdicpw – Tdicdw
—
ns
IP58 Slave device data delay8
Tracc
0
—
Tdrp9 –Tlbd10 –Tdicur
–1.5
ns
IP59 Slave device data hold time8
Troh
Tdrp–Tlbd– Tdicdr
+1.5
—
Tdicpr – Tdicdr – 1.5
ns
IP60 Write data setup time
Tds
Tdicdw – 1.5
Tdicdw
—
ns
IP61 Write data hold time
Tdh
Tdicpw – Tdicdw – 1.5
Tdicpw – Tdicdw
—
ns
IP62 Read period2
Tdicpr
Tdicpr – 1.5
Tdicpr
Tdicpr + 1.5
ns
IP63 Write period3
Tdicpw
Tdicpw – 1.5
Tdicpw
Tdicpw + 1.5
ns
IP64 Read down time4
Tdicdr
Tdicdr – 1.5
Tdicdr
Tdicdr + 1.5
ns
IP65 Read up time5
Tdicur
Tdicur – 1.5
Tdicur
Tdicur + 1.5
ns
IP66 Write down time6
Tdicdw
Tdicdw – 1.5
Tdicdw
Tdicdw + 1.5
ns
IP67 Write up time7
Tdicuw
Tdicuw – 1.5
Tdicuw
Tdicuw + 1.5
ns
IP68 Read time point9
Tdrp
Tdrp – 1.5
Tdrp
Tdrp + 1.5
ns
1 The exact conditions have not been finalized, but will likely match the current customer requirement for their specific display.
These conditions may be device specific.
2 Display interface clock period value for read:
3 Display interface clock period value for write:
4 Display interface clock down time for read:
5 Display interface clock up time for read:
6 Display interface clock down time for write:
7 Display interface clock up time for write:
8 This parameter is a requirement to the display connected to the IPU.
Table 59. Asynchronous Serial Interface Timing Parameters—Access Level (continued)
ID
Parameter
Symbol
Min.
Typ.1
Max.
Units
Tdicpr
T
HSP_CLK
ceil
DISP#_IF_CLK_PER_RD
HSP_CLK_PERIOD
----------------------------------------------------------------
=
Tdicpw
T
HSP_CLK
ceil
DISP#_IF_CLK_PER_WR
HSP_CLK_PERIOD
------------------------------------------------------------------
=
Tdicdr
1
2
--- T
HSP_CLK
ceil
2 DISP#_IF_CLK_DOWN_RD
HSP_CLK_PERIOD
-------------------------------------------------------------------------------
=
Tdicur
1
2
--- T
HSP_CLK
ceil
2 DISP#_IF_CLK_UP_RD
HSP_CLK_PERIOD
--------------------------------------------------------------------
=
Tdicdw
1
2
--- T
HSP_CLK
ceil
2 DISP#_IF_CLK_DOWN_WR
HSP_CLK_PERIOD
---------------------------------------------------------------------------------
=
Tdicuw
1
2
--- T
HSP_CLK
ceil
2 DISP#_IF_CLK_UP_WR
HSP_CLK_PERIOD
----------------------------------------------------------------------
=
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