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參數(shù)資料
| 型號(hào)： | MCF5329CVM240J |
| 廠商： | Freescale Semiconductor |
| 文件頁(yè)數(shù)： | 25/50頁(yè) |
| 文件大小： | 0K |
| 描述： | IC MPU RISC 240MHZ 256MAPBGA |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 系列： | MCF532x |
| 核心處理器： | Coldfire V3 |
| 芯體尺寸： | 32-位 |
| 速度： | 240MHz |
| 連通性： | CAN，EBI/EMI，以太網(wǎng)，I²C，SPI，SSI，UART/USART，USB，USB OTG |
| 外圍設(shè)備： | DMA，LCD，PWM，WDT |
| 輸入/輸出數(shù)： | 94 |
| 程序存儲(chǔ)器類(lèi)型： | ROMless |
| RAM 容量： | 32K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.4 V ~ 3.6 V |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 256-LBGA |
| 包裝： | 托盤(pán) |
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Electrical Characteristics
MCF532x ColdFire Microprocessor Data Sheet, Rev. 5
Freescale Semiconductor
31
Figure 17. Sharp TFT Panel Timing
Table 15. 4/8/12/16/18 Bit/Pixel TFT Color Mode Panel Timing
Number
Description
Minimum
Value
Unit
T1
End of LCD_OE to beginning of LCD_VSYNC
T5+T6+T7-1
(VWAIT1T2)+T5+T6+T7-1
Ts
T2
LCD_HSYNC period
—
XMAX+T5+T6+T7
Ts
T3
LCD_VSYNC pulse width
T2
VWIDTHT2
Ts
T4
End of LCD_VSYNC to beginning of LCD_OE
1
(VWAIT2T2)+1
Ts
T5
LCD_HSYNC pulse width
1
HWIDTH+1
Ts
T6
End of LCD_HSYNC to beginning to LCD_OE
3
HWAIT2+3
Ts
T7
End of LCD_OE to beginning of LCD_HSYNC
1
HWAIT1+1
Ts
Note: Ts is the LCD_LSCLK period. LCD_VSYNC, LCD_HSYNC and LCD_OE can be programmed as active high or active
low. In Figure 16, all 3 signals are active low. LCD_LSCLK can be programmed to be deactivated during the
LCD_VSYNC pulse or the LCD_OE deasserted period. In Figure 16, LCD_LSCLK is always active.
Note: XMAX is defined in number of pixels in one line.
D1
D2
D320
LCD_LSCLK
LCD_LD
LCD_SPL_SPR
LCD_HSYNC
LCD_CLS
LCD_PS
LCD_REV
XMAX
T2
D320
T1
T3
T5
T4
T7
T6
T2
T4
T7
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