參數(shù)資料
型號: MCF5307FT90B
廠商: Freescale Semiconductor
文件頁數(shù): 418/484頁
文件大小: 0K
描述: IC MPU 32BIT COLDF 90MHZ 208FQFP
標準包裝: 24
系列: MCF530x
核心處理器: Coldfire V3
芯體尺寸: 32-位
速度: 90MHz
連通性: EBI/EMI,I²C,UART/USART
外圍設備: DMA,POR,WDT
輸入/輸出數(shù): 16
程序存儲器類型: ROMless
RAM 容量: 4K x 8
電壓 - 電源 (Vcc/Vdd): 3 V ~ 3.6 V
振蕩器型: 外部
工作溫度: 0°C ~ 70°C
封裝/外殼: 208-BFQFP
包裝: 托盤
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INDEX
Index
Index-17
A
Accumulator (ACC), 2-28
Addressing
mode summary, 2-33
variant, 5-5
Arbitration
between masters, 6-14
bus control, 6-11
for internal transfers, 6-12
B
Baud rates
calculating, 14-19
Bus operation
arbitration control, 6-11
characteristics, 18-2
control signals, 18-1
data transfer
back-to-back cycles, 18-10
burst cycles
line read bus, 18-12
line transfers, 18-12
line write bus, 18-14
mixed port sizes, 18-15
overview, 18-11
cycle execution, 18-4
cycle states, 18-5
fast-termination cycles, 18-9
operation, 18-3
read cycle, 18-7
write cycle, 18-8
errors, 18-17
external master transfers
general, 18-21
two-device arbitration protocol, 18-25
two-wire mode, 18-25
features, 18-1
interrupt exceptions, 18-17
master park register, 6-11
misaligned operands, 18-16
reset
master, 18-34
overview, 18-33
software watchdog, 18-35
C
CCR, 2-28
Chip-select module
8-, 16-, and 32-bit port sizing, 10-4
enable signals, 17-15
operation, 10-2
general, 10-3
global, 10-4
overview, 10-1
registers, 10-5, 10-6, A-2
code example, 10-9
control, 10-8
mask, 10-6
signals, 10-1
Clock
PLL control, 6-10
ColdFire core
addressing mode summary, 2-33
condition code register (CCR), 2-28
exception processing overview, 2-47
features and enhancements, 2-21
instruction set summary, 2-34
integer data formats, 2-31
MAC registers, 1-14
programming model, 2-26
status register, 2-29
supervisor programming model, 2-29
user programming mode, 2-27
CPU STOP instruction, 6-10
D
Debug
attribute trigger register, 5-7
BDM command set summary, 5-20
breakpoint operation, 5-40
real-time support, 5-39
taken branch, 5-4
theory, 5-40
DMA controller module
byte count registers, 12-7
programming model, 12-4
signal description, 12-2
source address registers, 12-6
timing specifications, 20-19
transfer overview, 12-3
DRAM controller
asynchronous operation
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
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Go to: www.freescale.com
n
c
..
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PDF描述
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參數(shù)描述
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