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參數(shù)資料
| 型號： | MCF5307FT90B |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 148/484頁 |
| 文件大小： | 0K |
| 描述： | IC MPU 32BIT COLDF 90MHZ 208FQFP |
| 標(biāo)準(zhǔn)包裝： | 24 |
| 系列： | MCF530x |
| 核心處理器： | Coldfire V3 |
| 芯體尺寸： | 32-位 |
| 速度： | 90MHz |
| 連通性： | EBI/EMI，I²C，UART/USART |
| 外圍設(shè)備： | DMA，POR，WDT |
| 輸入/輸出數(shù)： | 16 |
| 程序存儲器類型： | ROMless |
| RAM 容量： | 4K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 3 V ~ 3.6 V |
| 振蕩器型： | 外部 |
| 工作溫度： | 0°C ~ 70°C |
| 封裝/外殼： | 208-BFQFP |
| 包裝： | 托盤 |
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Chapter 10. Chip-Select Module
10-7
Chip-Select Registers
.
Table 10-8 describes CSMR elds.
31
16 15
9
8
7
6
5
4321
0
Field
BAM
—
WP — AM C/I SC SD UC UD V
Reset
Unitialized
0
R/W
Addr
0x084 (CSMR0); 0x090 (CSMR1); 0x09C (CSMR2); 0x0A8 (CSMR3);
0x0B4 (CSMR4); 0x0C0 (CSMR5); 0x0CC (CSMR6); 0x0D8 (CSMR7)
Figure 10-3. Chip Select Mask Registers (CSMRn)
Table 10-8. CSMRn Field Descriptions
Bits
Name
Description
31–16
BAM
Base address mask. Denes the chip select block by masking address bits. Setting a BAM bit
causes the corresponding CSAR bit to be ignored in the decode.
0 Corresponding address bit is used in chip-select decode.
1 Corresponding address bit is a don’t care in chip-select decode.
The block size for CS[7:0] is 2n; n = (number of bits set in respective CSMR[BAM]) + 16.
So, if CSAR0 = 0x0000 and CSMR0[BAM] = 0x0008, CS0 would address two discontinuous
64-Kbyte memory blocks: one from 0x0000–0xFFFF and one from 0x8_0000–0x8_FFFF.
Likewise, for CS0 to access 32 Mbytes of address space starting at location 0x0, CS1 must begin
at the next byte after CS0 for a 16-Mbyte address space. Then CSAR0 = 0x0000,
CSMR0[BAM] = 0x01FF, CSAR1 = 0x0200, and CSMR1[BAM] = 0x00FF.
8
WP
Write protect. Controls write accesses to the address range in the corresponding CSAR.
Attempting to write to the range of addresses for which CSARn[WP] = 1 results in the appropriate
chip select not being selected. No exception occurs.
0 Both read and write accesses are allowed.
1 Only read accesses are allowed.
7
—
Reserved, should be cleared.
6
AM
Alternate master. When AM = 0 during an external master or DMA access, SC, SD, UC, and UD
are don’t cares in the chip-select decode.
5–1
C/I,
SC,
SD,
UC,
UD
Address space mask bits. These bits determine whether the specied accesses can occur to the
address space dened by the BAM for this chip select.
C/I
CPU space and interrupt acknowledge cycle mask
SC
Supervisor code address space mask
SD
Supervisor data address space mask
UC User code address space mask
UD User data address space mask
0 The address space assigned to this chip select. is available to the specied access type.
1 The address space assigned to this chip select. is not available (masked) to the specied access
type. If this address space is accessed, chip select is not activated and a regular external bus
cycle occurs.
Note that if if AM = 0, SC, SD, UC, and UD are ignored in the chip select decode on external
master or DMA access.
0
V
Valid bit. Indicates whether the corresponding CSAR, CSMR, and CSCR contents are valid.
Programmed chip selects do not assert until V is set (except for CS0, which acts as the global chip
select). Reset clears each CSMRn[V].
0 Chip select invalid
1 Chip select valid
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述 |
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