參數(shù)資料
型號： MCF5249VF140
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, 140 MHz, RISC PROCESSOR, PBGA160
封裝： 15 X 15 MM, MAPBGA-160
文件頁數(shù)： 276/454頁
文件大?。?/td> 6701K
代理商： MCF5249VF140
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Real-Time Trace Support
MOTOROLA
Debug Support
19-5
appropriate marker and then the data transfer on the DDATA outputs. The length of the data transfer is
dependent on the operand size of the WDDATA instruction.
19.2.1.5
Begin Execution of Taken Branch (PST = $5)
The bytes are always displayed in a least-significant to most-significant order. The processor captures only
those target addresses associated with taken branches using a variant addressing mode. For example, all
JMP and JSR instructions using address register indirect or indexed addressing modes, all RTE and RTS
instructions as well as all exception vectors.
The simplest example of a branch instruction using a variant address is the compiled code for a C
language “case” statement. Typically, the evaluation of this statement uses the variable of an expression
as an index into a table of offsets, where each offset points to a unique case within the structure. For these
types of change-of-flow operations, the ColdFire processor uses the debug pins to output a sequence of
information on successive processor clock cycles:
1. Identify a taken branch has been executed using the PST pins ($5).
2. Using the PST pins, optionally signal the target address is to be displayed on the DDATA pins. The
encoding ($9, $A, $B) identifies the number of bytes that are displayed.
3. The new target address is optionally available on subsequent cycles using the nibble-wide DDATA
port. The number of bytes of the target address displayed on this port is a configurable parameter
(2, 3, or 4 bytes).
Another example of a variant branch instruction would be a JMP (A0) instruction. Figure 19-2 shows the
Figure 19-2 Example PST/DDATA Diagram
PST is driven with a $5 indicating a taken branch. In the second cycle, PST is driven with a marker value of
$9 indicating a two-byte address that is displayed four bits at a time on the DDATA signals over the next
four clock cycles. The remaining four clock cycles display the lower two-bytes of the address (A0), least
significant nibble to most significant nibble. The output of the PST signals after the JMP instruction
completes is dependent on the target instruction. The PST can continue with the next instruction before the
address has completely displayed on the DDATA because of the DDATA FIFO. If the FIFO is full and the
next instruction needs to display captured values on DDATA, the pipeline stalls (PST = $0) until space is
available in the FIFO.
PSTCLK
PST
DData
$5
$0
$9
A[3:0]
A[7:4]
A[11:8]
A[15:12]
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述
MCF5251CDVM140 32-BIT, 140 MHz, MICROPROCESSOR, PBGA225
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MCF5251EVM140 32-BIT, 140 MHz, MICROPROCESSOR, PBGA225
MCF54417CMJ250 MICROPROCESSOR, PBGA256
MCF54418CMJ250 MICROPROCESSOR, PBGA256
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參數(shù)描述
MCF5249VM140 功能描述:IC MPU 32B 140MHZ COLDF 160-BGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:MCF524x 標(biāo)準(zhǔn)包裝:1 系列:87C 核心處理器:MCS 51 芯體尺寸:8-位 速度:16MHz 連通性:SIO 外圍設(shè)備:- 輸入/輸出數(shù):32 程序存儲器容量:8KB（8K x 8） 程序存儲器類型:OTP EEPROM 大小:- RAM 容量:256 x 8 電壓 - 電源 (Vcc/Vdd):4 V ~ 6 V 數(shù)據(jù)轉(zhuǎn)換器:- 振蕩器型:外部 工作溫度:0°C ~ 70°C 封裝/外殼:44-DIP 包裝:管件 其它名稱:864285
MCF5251 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ColdFire㈢ Microprocessor
MCF5251_07 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ColdFire㈢ Microprocessor Data Sheet
MCF5251_08 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ColdFire㈢ Microprocessor
MCF5251CDVM140 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:ColdFire Processor
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